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参数资料
| 型号： | PIC24HJ12GP201-E/SO |
| 厂商： | Microchip Technology |
| 文件页数： | 214/262页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 12KB 18SOIC |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 42 |
| 系列： | PIC® 24H |
| 核心处理器： | PIC |
| 芯体尺寸： | 16-位 |
| 速度： | 40 MIP |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 13 |
| 程序存储器容量： | 12KB（4K x 24） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 6x10b/12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 18-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
| 配用： | AC164339-ND - MODULE SKT FOR PM3 28SOIC |
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2007-2011 Microchip Technology Inc.
DS70282E-page 55
PIC24HJ12GP201/202
FIGURE 6-2:
SYSTEM RESET TIMING
Reset
Run
Device Status
VDD
VPOR
Vbor
VBOR
POR
BOR
SYSRST
TPWRT
TPOR
TBOR
Oscillator Clock
TOSCD
TOST
TLOCK
Time
FSCM
TFSCM
1
2
3
4
5
6
1.
POR:
A POR circuit holds the device in Reset when the power supply is turned on. The POR circuit is active until VDD crosses the
VPOR threshold and the delay TPOR has elapsed.
2.
BOR:
The on-chip voltage regulator has a BOR circuit that keeps the device in Reset until VDD crosses the VBOR threshold and the
delay TBOR has elapsed. The delay TBOR ensures the voltage regulator output becomes stable.
3.
PWRT Timer:
The programmable power-up timer continues to hold the processor in Reset for a specific period of time (TPWRT)
after a BOR. The delay TPWRT ensures that the system power supplies have stabilized at the appropriate level for full-speed oper-
ation. After the delay TPWRT has elapsed, the SYSRST becomes inactive, which in turn enables the selected oscillator to start
generating clock cycles.
4.
Oscillator Delay:
The total delay for the clock to be ready for various clock source selections are given in Table 6-1. Refer to
for more information.
5.
When the oscillator clock is ready, the processor begins execution from location 0x000000. The user application programs a GOTO
instruction at the Reset address, which redirects program execution to the appropriate start-up routine.
6.
The Fail-safe clock monitor (FSCM), if enabled, begins to monitor the system clock when the system clock is ready and the delay
TFSCM elapsed.
TABLE 6-2:
OSCILLATOR PARAMETERS
Symbol
Parameter
Value
VPOR
POR threshold
1.8V nominal
TPOR
POR extension time 30
μs maximum
VBOR
BOR threshold
2.5V nominal
TBOR
BOR extension time 100
μs maximum
TPWRT
Programmable
power-up time
delay
0-128 ms nominal
TFSCM
Fail-safe Clock
Monitor Delay
900
μs maximum
Note:
When the device exits the Reset condi-
tion (begins normal operation), the
device operating parameters (voltage,
frequency, temperature, etc.) must be
within their operating ranges, other-
wise the device may not function cor-
rectly.
The
user
application
must
ensure that the delay between the time
power is first applied, and the time
SYSRST becomes inactive, is long
enough to get all operating parameters
within specification.
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