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参数资料
| 型号： | PIC24HJ32GP204-I/ML |
| 厂商： | Microchip Technology |
| 文件页数： | 170/289页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 32K 44QFN |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 45 |
| 系列： | PIC® 24H |
| 核心处理器： | PIC |
| 芯体尺寸： | 16-位 |
| 速度： | 40 MIP |
| 连通性： | I²C，IrDA，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 35 |
| 程序存储器容量： | 32KB（11K x 24） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 13x10b/12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-VQFN 裸露焊盘 |
| 包装： | 管件 |
| 产品目录页面： | 648 (CN2011-ZH PDF) |
| 配用： | 876-1004-ND - PIC24 BREAKOUT BOARD DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32 |
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CHAPTER 7 16-BIT TIMER/EVENT COUNTER Q (TMQ)
User’s Manual U17716EJ2V0UD
250
(6) TMQn option register 0 (TQnOPT0)
The TQnOPT0 register is an 8-bit register used to set the capture/compare operation and detect overflow.
This register can be read or written in 8-bit or 1-bit units.
Reset sets this register to 00H.
TQ0CCS3Note 1
TQ0CCSm
0
1
TQ0CCRm register capture/compare selection (m = 0 to 3)
The TQ0CCSm bit setting is valid only in the free-running timer mode.
Compare register selected
Capture register selected (cleared by TQ0CTL0.TQ0CE bit = 0)
TQnOPT0
(n = 0, 1)
TQ0CCS2Note 1 TQ0CCS1Note 1 TQ0CCS0Note 1
0
TQ1CMSNote 2 TQ1CUFNote 2 TQnOVF
<6>
<5>
<4>
3
<2>
<1>
After reset: 00H
R/W
Address: TQ0OPT0 FFFFF5C5H, TQ1OPT0 FFFFF605H
TQnOVF
Set (1)
Reset (0)
TMQn overflow flag
The TQnOVF bit is set (1) when the 16-bit counter value overflows from FFFFH to
0000H in the free-running timer mode or the pulse width measurement mode.
An overflow interrupt request signal (INTTQnOV) is generated at the same time
that the TQnOVF bit is set (1). The INTTQnOV signal is not generated in modes
other than the free-running timer mode and the pulse width measurement mode.
The TQnOVF bit is not cleared to 0 even when the TQnOVF bit or the TQnOPT0
register is read when the TQnOVF bit = 1.
Before clearing the TQnOVF bit to 0 after generation of the INTTQnOV signal, be
sure to confirm (by reading) that the TQnOVF bit is set to 1.
The TQnOVF bit can be read or written, but the TQnOVF bit cannot be set (1) by
software. Writing 1 has no effect on the TMQn operation.
Overflow occurred
0 written to TQnOVF bit or TQnCTL0.TQnCE bit = 0
<7>
<0>
Notes 1. Valid only in TMQ0. Be sure to clear bits 7 to 4 in TMQ1 to 0.
2. Valid only in TMQ1. Be sure to clear bits 2 and 1 of TMQ0 to 0. For details of the TQ1CMS and
TQ1CUF bits, see CHAPTER 9 MOTOR CONTROL FUNCTION.
Cautions 1. Rewrite the TQ0CCS3 to TQ0CCS0 bits when the TQ0CE bit = 0. (The same value can be
written when the TQ0CE bit = 1.)
If rewriting was mistakenly performed, clear (0) the
TQ0CE bit = 0 and then set the bits again.
2. Be sure to clear bit 3 to “0”.
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参数描述 |
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