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参数资料
型号： PIC32MX320F128L-80V/BG
厂商： Microchip Technology
文件页数： 148/214页
文件大小： 0K
描述： IC MCU 32BIT 128KB FLSH 121XBGA
标准包装： 184
系列： PIC® 32MX
核心处理器： MIPS32? M4K?
芯体尺寸： 32-位
速度： 80MHz
连通性： I²C，IrDA，LIN，PMP，SPI，UART/USART
外围设备： 欠压检测/复位，POR，PWM，WDT
程序存储器容量： 128KB（128K x 8）
程序存储器类型： 闪存
RAM 容量： 16K x 8
电压 - 电源 (Vcc/Vdd)： 2.3 V ~ 3.6 V
数据转换器： A/D 16x10b
振荡器型： 内部
工作温度： -40°C ~ 105°C
封装/外壳： 121-TFBGA
包装： 托盘
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2011 Microchip Technology Inc.
DS61143H-page 39
PIC32MX3XX/4XX
The MIPS architecture defines that the result of a mul-
tiply or divide operation be placed in the HI and LO reg-
isters. Using the Move-From-HI (MFHI) and Move-
From-LO (MFLO) instructions, these values can be
transferred to the general purpose register file.
In addition to the HI/LO targeted operations, the
MIPS32 architecture also defines a multiply instruction,
MUL, which places the least significant results in the
primary register file instead of the HI/LO register pair.
By avoiding the explicit MFLO instruction, required
when using the LO register, and by supporting multiple
destination
registers,
the
throughput
of
multiply-intensive operations is increased.
Two other instructions, multiply-add (MADD) and multi-
ply-subtract (MSUB), are used to perform the multiply-
accumulate and multiply-subtract operations. The
MADD
instruction multiplies two numbers and then adds
the product to the current contents of the HI and LO
registers. Similarly, the MSUB instruction multiplies two
operands and then subtracts the product from the HI
and LO registers. The MADD and MSUB operations
are commonly used in DSP algorithms.
3.2.3
SYSTEM CONTROL
COPROCESSOR (CP0)
In the MIPS architecture, CP0 is responsible for the vir-
tual-to-physical address translation, the exception con-
trol system, the processor’s diagnostics capability, the
operating modes (kernel, user and debug), and
whether interrupts are enabled or disabled. Configura-
tion information, such as presence of options like
MIPS16e, is also available by accessing the CP0
registers, listed in Table 3-2.
TABLE 3-1:
MIPS M4K PROCESSOR CORE HIGH-PERFORMANCE INTEGER
MULTIPLY/DIVIDE UNIT LATENCIES AND REPEAT RATES
Opcode
Operand Size (mul rt) (div rs)
Latency
Repeat Rate
MULT/MULTU, MADD/MADDU,
MSUB/MSUBU
16 bits
1
32 bits
2
MUL
16 bits
2
1
32 bits
3
2
DIV/DIVU
8 bits
12
11
16 bits
19
18
24 bits
26
25
32 bits
33
32
TABLE 3-2:
COPROCESSOR 0 REGISTERS
Register
Number
Register
Name
Function
0-6
Reserved
7
HWREna
Enables access via the RDHWR instruction to selected hardware registers
8
BadVAddr(1)
Reports the address for the most recent address-related exception
9
Count(1)
Processor cycle count
10
Reserved
11
Compare(1)
Timer interrupt control
12
Status(1)
Processor status and control
12
IntCtl(1)
Interrupt system status and control
12
SRSCtl(1)
Shadow register set status and control
12
SRSMap(1)
Provides mapping from vectored interrupt to a shadow set
13
Cause(1)
Cause of last general exception
14
EPC(1)
Program counter at last exception
15
PRId
Processor identification and revision
15
EBASE
Exception vector base register
16
Config
Configuration register
16
Config1
Configuration register 1
16
Config2
Configuration register 2
16
Config3
Configuration register 3
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PDF描述
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PIC32MX320F128LT-80V/PT 功能描述:32位微控制器 - MCU 128 KB FL 16 KB RAM 80MHz 10-Bit ADC DMA RoHS:否 制造商:Texas Instruments 核心:C28x 处理器系列:TMS320F28x 数据总线宽度:32 bit 最大时钟频率:90 MHz 程序存储器大小:64 KB 数据 RAM 大小:26 KB 片上 ADC:Yes 工作电源电压:2.97 V to 3.63 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:LQFP-80 安装风格:SMD/SMT
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