参数资料
型号: PK30X256VMD100
厂商: Freescale Semiconductor
文件页数: 49/74页
文件大小: 0K
描述: IC ARM CORTEX MCU 256K 144-MAP
产品培训模块: Kinetis® Cortex-M4 Microcontroller Family
标准包装: 1
系列: Kinetis
核心处理器: ARM? Cortex?-M4
芯体尺寸: 32-位
速度: 100MHz
连通性: CAN,EBI/EMI,I²C,IrDA,SDHC,SPI,UART/USART
外围设备: DMA,I²S,LCD,LVD,POR,PWM,WDT
输入/输出数: 102
程序存储器容量: 256KB(256K x 8)
程序存储器类型: 闪存
EEPROM 大小: 4K x 8
RAM 容量: 64K x 8
电压 - 电源 (Vcc/Vdd): 1.71 V ~ 3.6 V
数据转换器: A/D 37x16b,D/A 2x12b
振荡器型: 内部
工作温度: -40°C ~ 105°C
封装/外壳: 144-LBGA
包装: 托盘
6.8.1 CAN switching specifications
6.8.2 DSPI switching specifications (limited voltage range)
The DMA Serial Peripheral Interface (DSPI) provides a synchronous serial bus with
master and slave operations. Many of the transfer attributes are programmable. The tables
below provide DSPI timing characteristics for classic SPI timing modes. Refer to the
DSPI chapter of the Reference Manual for information on the modified transfer formats
used for communicating with slower peripheral devices.
Table 38. Master mode DSPI timing (limited voltage range)
Num
Description
Min.
Max.
Unit
Notes
Operating voltage
2.7
3.6
V
Frequency of operation
25
MHz
DS1
DSPI_SCK output cycle time
2 x tBUS
ns
DS2
DSPI_SCK output high/low time
(tSCK/2) 2 (tSCK/2) + 2
ns
DS3
DSPI_PCSn valid to DSPI_SCK delay
(tBUS x 2)
2
ns
DS4
DSPI_SCK to DSPI_PCSn invalid delay
(tBUS x 2)
2
ns
DS5
DSPI_SCK to DSPI_SOUT valid
8.5
ns
DS6
DSPI_SCK to DSPI_SOUT invalid
2
ns
DS7
DSPI_SIN to DSPI_SCK input setup
15
ns
DS8
DSPI_SCK to DSPI_SIN input hold
0
ns
1. The delay is programmable in SPIx_CTARn[PSSCK] and SPIx_CTARn[CSSCK].
2. The delay is programmable in SPIx_CTARn[PASC] and SPIx_CTARn[ASC].
DS3
DS4
DS1
DS2
DS7
DS8
First data
Last data
DS5
First data
Data
Last data
DS6
Data
DSPI_PCSn
DSPI_SCK
(CPOL=0)
DSPI_SIN
DSPI_SOUT
Figure 19. DSPI classic SPI timing — master mode
Peripheral operating requirements and behaviors
K30 Sub-Family Data Sheet Data Sheet, Rev. 7, 02/2013.
Freescale Semiconductor, Inc.
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