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参数资料
| 型号： | PSD712S5 |
| 英文描述： | Field Programmable Microcontroller Peripherals with Supervisory Functions(可编程逻辑，4K位SRAM,27个可编程I/O,通用PLD有66个输入) |
| 中文描述： | 现场可编程微控制器外围设备具有监督职能（可编程逻辑，4K的位的SRAM，27余个可编程输入/输出，通用PLD的有66个输入） |
| 文件页数： | 10/104页 |
| 文件大小： | 515K |
| 代理商： | PSD712S5 |
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PSD7XX Family
13-10
PSD7XX
Register
Description
and Address
Offset
(
cont.)
Register Name
Port A Port B Port C Port D Other*
Description
Data In
00
01
10
11
Reads Port pin as input,
MCU I/O input mode
Selects mode between
MCU I/O or Address Out
Stores data for output
to Port pins, MCU I/O
output mode
Configures Port pin as
input or output
Configures Port pin
between CMOS, Open
Drain and Slew Rate
Reads Input Micro
Cell
Reads the status of the
output enable to the I/O
Port driver
Read – reads output of
Micro
Cells
(McellC, McellAB)
Write – loads Micro
cell
Flip-Flops
Power Management
Register 0
Power Management
Register 1
Page Register
8031/PIO Configuration
Register
Read only Supervisory
register. Indicates the
status and source of reset
and reference voltage level.
Write only. A write to the
register clears the reset
status bits in the Status
Register.
Read only. Indicates the
status of all Supervisory
I/O pins.
Read only. Indicates the
configuration of the
WatchDog Timer.
Contains WatchDog Timer
count bits 0–7.
Contains WatchDog Timer
count bit 8, the clock source
and reset pulse width.
Control
02
03
Data Out
04
05
12
13
Direction
06
07
14
15
Drive
08
09
16
17
Input Micro
Cell
Enable Out
0A
0C
0B
0D
18
1A
Output
Micro
Cell
20
20
21
PMMR0
B0
PMMR1
B2
Page
VM
E0
E2
Status
D8
Reset-Clr
D6
Supv-Pins
DA
WD-Conf
D4
WD-Count
D0
WD-Misc
D2
Table 5. Register Address Offset
*
Other registers that are not part of the I/O ports.
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PDF描述 |
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