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参数资料
型号： R5F100LJAFC#V0
厂商： Renesas Electronics America
文件页数： 268/395页
文件大小： 0K
描述： MCU 16BIT 256KB FLASH 64LQFP
产品培训模块： RL78 ADC
标准包装： 1
系列： RL78/G13
核心处理器： RL78
芯体尺寸： 16-位
速度： 32MHz
连通性： CSI，I²C，LIN，UART/USART
外围设备： DMA，POR，PWM，WDT
输入/输出数： 48
程序存储器容量： 256KB（256K x 8）
程序存储器类型： 闪存
RAM 容量： 20K x 8
电压 - 电源 (Vcc/Vdd)： 1.65 V ~ 5.5 V
数据转换器： A/D 12x8/10b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 64-TQFP
包装： 托盘
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PIC18F6525/6621/8525/8621
DS39612B-page 338
2005 Microchip Technology Inc.
TABLE 27-7:
PLL CLOCK TIMING SPECIFICATIONS (VDD = 4.2 TO 5.5V)
FIGURE 27-6:
CLKO AND I/O TIMING
TABLE 27-8:
CLKO AND I/O TIMING REQUIREMENTS
Param. No.
Sym
Characteristic
Min
Typ
Max
Units
Conditions
FOSC
Oscillator Frequency Range
4
—
10
MHz HS mode
FSYS
On-Chip VCO System Frequency
16
—
40
MHz HS mode
trc
PLL Start-up Time (Lock Time)
—
2
ms
CLK
CLKO Stability (Jitter)
-2
—
+2
%
Data in “Typ” column is at 5V, 25
°C, unless otherwise stated. These parameters are for design guidance
only and are not tested.
Param
No.
Symbol
Characteristic
Min
Typ
Max
Units
Conditions
10
TosH2ckL
OSC1
↑ to CLKO ↓
—
75
200
ns
(Note 1)
11
TosH2ckH OSC1
↑ to CLKO ↑
—
75
200
ns
(Note 1)
12
TckR
CLKO Rise Time
—
35
100
ns
(Note 1)
13
TckF
CLKO Fall Time
—
35
100
ns
(Note 1)
14
TckL2ioV
CLKO
↓ to Port Out Valid
—
0.5 TCY + 20
ns
(Note 1)
15
TioV2ckH
Port In Valid before CLKO
↑
0.25 TCY + 25
—
ns
(Note 1)
16
TckH2ioI
Port In Hold after CLKO
↑
0—
—
ns
(Note 1)
17
TosH2ioV
OSC1
↑ (Q1 cycle) to Port Out Valid
—
50
150
ns
18
TosH2ioI
OSC1
↑ (Q2 cycle) to Port
Input Invalid (I/O in hold time)
PIC18F6X2X/8X2X
100
—
ns
18A
PIC18LF6X2X/8X2X
200
—
ns
19
TioV2osH
Port Input Valid to OSC1
↑ (I/O in setup time)
0
—
ns
20
TioR
Port Output Rise Time
PIC18F6X2X/8X2X
—
10
25
ns
20A
PIC18LF6X2X/8X2X
—
60
ns
21
TioF
Port Output Fall Time
PIC18F6X2X/8X2X
—
10
25
ns
21A
PIC18LF6X2X/8X2X
—
60
ns
22
TINP
INT pin High or Low Time
TCY
——
ns
23
TRBP
RB7:RB4 Change INT High or Low Time
TCY
——
ns
24
TRCP
RC7:RC4 Change INT High or Low Time
20
ns
These parameters are asynchronous events not related to any internal clock edges.
Note
1:
Measurements are taken in RC mode, where CLKO output is 4 x TOSC.
Note:
Refer to Figure 27-4 for load conditions.
OSC1
CLKO
I/O pin
(input)
I/O pin
(output)
Q4
Q1
Q2
Q3
10
13
14
17
20, 21
19
18
15
11
12
16
Old Value
New Value
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