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参数资料
| 型号： | R5F211A4DD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDIP20 |
| 封装： | 6.30 X 19 MM, 1.78 MM PITCH, PLASTIC, SDIP-20 |
| 文件页数： | 123/339页 |
| 文件大小： | 3220K |
| 代理商： | R5F211A4DD |
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R8C/1A Group, R8C/1B Group
Rev.1.30
Dec 08, 2006
Page 193 of 315
REJ09B0252-0130
16.2.6.2
Data Transmission
Figure 16.19 shows an Example of Clock Synchronous Serial I/O with Chip Select Operation during Data
Transmission (4-Wire Bus Communication Mode). During the data transmit operation, clock synchronous
serial I/O with chip select operates as described below.
When the MCU is set as the master device, it outputs a synchronous clock and data. When the MCU is set as a
slave device, it outputs data in synchronization with the input clock while the SCS pin is “L”.
When the transmit data is written to the SSTDR register after setting the TE bit to 1 (transmit enabled), the
TDRE bit is automatically set to 0 (data has not been transferred from registers SSTDR to SSTRSR) and the
data is transferred from registers SSTDR to SSTRSR. After the TDRE bit is set to 1 (data is transferred from
registers SSTDR to SSTRSR), transmission starts. When the TIE bit in the SSER register is set to 1, a TXI
interrupt request is generated.
After 1 frame of data is transferred while the TDRE bit is set to 0, the data is transferred from registers SSTDR
to SSTRSR and transmission of the next frame is started. If the 8th bit is transmitted while TDRE is set to 1,
TEND in the SSSR register is set to 1 (when the last bit of the transmit data is transmitted, the TDRE bit is set
to 1) and the state is retained. If the TEIE bit in the SSER register is set to 1 (transmit-end interrupt requests
enabled), a TEI interrupt request is generated. The SSCK pin remains “H” after transmit-end and the SCS pin is
held “H”. When transmitting continuously while the SCS pin is held “L”, write the next transmit data to the
SSTDR register before transmitting the 8th bit.
Transmission cannot be performed while the ORER bit in the SSSR register is set to 1 (overrun error). Confirm
that the ORER bit is set to 0 before transmission.
In contrast to the clock synchronous communication mode, the SSO pin is placed in high-impedance state while
the SCS pin is placed in high-impedance state when operating as a master device and the SSI pin is placed in
high-impedance state while the SCS pin is placed in “H” input state when operating as a slave device.
The sample flowchart is the same as that for the clock synchronous communication mode. (Refer to Figure
相关PDF资料 |
PDF描述 |
|---|---|
| R5F211A4DXXXSP | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO20 |
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| R5F211B1SP | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO20 |
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相关代理商/技术参数 |
参数描述 |
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| R5F211A4DD#V0 | 功能描述:IC R8C MCU FLASH 16K 20SDIP RoHS:是 类别:集成电路 (IC) >> 嵌入式 - 微控制器， 系列:R8C/1x/1A 标准包装:250 系列:80C 核心处理器:8051 芯体尺寸:8-位 速度:16MHz 连通性:EBI/EMI，I²C，UART/USART 外围设备:POR，PWM，WDT 输入/输出数:40 程序存储器容量:- 程序存储器类型:ROMless EEPROM 大小:- RAM 容量:256 x 8 电压 - 电源 (Vcc/Vdd):4.5 V ~ 5.5 V 数据转换器:A/D 8x10b 振荡器型:内部 工作温度:-40°C ~ 85°C 封装/外壳:68-LCC（J 形引线） 包装:带卷 (TR) |
| R5F211A4DDD#U0 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 16KB FLASH 3.3V/5V 20PIN SDIP - Rail/Tube |
| R5F211A4DSP | 制造商:Renesas Electronics Corporation 功能描述:Micro,R8C/1A,ROM 16k FL,RAM 1k |
| R5F211A4DSP#U0 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16-Bit R8C CISC 16KB Flash 3.3V/5V 20-Pin LSSOP Tube 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 16KB FLASH 3.3V/5V 20PIN LSSOP - Rail/Tube 制造商:Renesas Electronics 功能描述:M16C 20MHz 制造商:Renesas Electronics Corporation 功能描述:IC R8C MCU FLASH 20LSSOP 制造商:Renesas 功能描述:MCU 16-Bit R8C CISC 16KB Flash 3.3V/5V 20-Pin LSSOP Tube |
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