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参数资料
| 型号： | R5F21237DFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP48 |
| 封装： | 7 X 7 MM, 0.50 MM PITCH, PLASTIC, LQFP-48 |
| 文件页数： | 32/38页 |
| 文件大小： | 473K |
| 代理商： | R5F21237DFP |
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Section 2 CPU
Rev. 2.00 Aug. 28, 2007 Page 26 of 1106
REJ09B0230-0200
Table 2.7
Access with Displacement
Type
CPU in this LSI
Example of Other CPUs
16-bit displacement
MOV.W
@(disp,PC),R0
MOV.W
@(R0,R1),R2
........
.DATA.W H'1234
MOV.W
@(H'1234,R1),R2
Note:
*
Immediate data is referenced by @(disp,PC).
2.4.2
Addressing Modes
Table 2.8 lists addressing modes and effective address calculation methods.
Table 2.8
Addressing Modes and Effective Addresses
Addressing
Mode
Instruction
Format
Effective Address Calculation Method
Calculation
Formula
Register
direct
Rn
Effective address is register Rn.
(Operand is register Rn contents.)
Register
indirect
@Rn
Effective address is register Rn contents.
Rn
Register
indirect with
post-increment
@Rn+
Effective address is register Rn contents. A
constant is added to Rn after instruction
execution: 1 for a byte operand, 2 for a word
operand, 4 for a longword operand.
Rn
1/2/4
+
Rn + 1/2/4
Rn
After instruction
execution
Byte: Rn + 1
→ Rn
Word: Rn + 2
→ Rn
Longword: Rn + 4
→ Rn
Register
indirect with
pre-decrement
@–Rn
Effective address is register Rn contents,
decremented by a constant beforehand: 1 for a
byte operand, 2 for a word operand, 4 for a
longword operand.
Rn
Rn - 1/2/4
1/2/4
-
Rn - 1/2/4
Byte: Rn – 1
→ Rn
Word: Rn – 2
→ Rn
Longword: Rn – 4
→ Rn
(Instruction
executed with Rn
after calculation)
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PDF描述 |
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