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参数资料
| 型号： | R5F363BENFE |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件页数： | 36/119页 |
| 文件大小： | 907K |
| 代理商： | R5F363BENFE |
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R01DS0033EJ0200 Rev.2.00
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Feb 07, 2011
M16C/63 Group
2. Central Processing Unit (CPU)
2.
Central Processing Unit (CPU)
Figure 2.1 shows the CPU registers. Seven registers (R0, R1, R2, R3, A0, A1, and FB) out of 13 compose a
register bank, and there are two register banks.
Figure 2.1
CPU Registers
R0H (upper bits of R0)
b15
b8 b7
b0
R3
INTBH
USP
ISP
SB
Note:
1. These registers compose a register bank. There are two register banks.
C
D
Z
S
B
O
I
U
IPL
R2
b31
R3
R2
A1
A0
FB
b19
INTBL
b15
b0
PC
INTBH is the 4 upper bits of the INTB register and INTBL
is the 16 lower bits.
b19
b0
b15
b0
FLG
b15
b0
b15
b0
b7
b8
Data registers (1)
Address registers (1)
Frame base registers (1)
Program counter
Interrupt table register
User stack pointer
Interrupt stack pointer
Static base register
Flag register
Reserved area
Carry flag
Debug flag
Zero flag
Sign flag
Register bank select flag
Overflow flag
Interrupt enable flag
Stack pointer select flag
Reserved area
Processor interrupt priority level
R1H (upper bits of R1)
R0L (lower bits of R0)
R1L (lower bits of R1)
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
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