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参数资料
| 型号： | R5F64115DFB |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 77/107页 |
| 文件大小： | 1192K |
| 代理商： | R5F64115DFB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页当前第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页
REJ03B0227-0110 Rev.1.10 Sep 17, 2009
Page 69 of 99
R32C/111 Group
5. Electrical Characteristics
Timing Requirements (VCC1 = VCC2 = 3.0 to 5.5 V, VSS =0 V, and Ta =Topr, unless otherwise noted)
Figure 5.5
Flash Memory CPU Rewrite Mode Timing
Table 5.14
Flash Memory CPU Rewrite Mode Timing
Symbol
Characteristics
Value
Unit
Min.
Max.
tcR
Read cycle time
200
ns
tsu(S-R)
Chip-select setup time for read
200
ns
th(R-S)
Chip-select hold time after read
0ns
tsu(A-R)
Address setup time for read
200
ns
th(R-A)
Address hold time after read
0ns
tw(R)
Read pulse width
100
ns
tcW
Write cycle time
200
ns
tsu(S-W)
Chip-select setup time for write
0ns
th(W-S)
Chip-select hold time after write
30
ns
tsu(A-W)
Address setup time for write
0ns
th(W-A)
Address hold time after write
30
ns
tw(W)
Write pulse width
50
ns
CS0
A23 to A0, BC0 to BC3
RD
t h(R-S)
Read cycle
t w(R)
t su(S-R)
t h(R-A)
t su(A-R)
Write cycle
CS0 to CS3
A23 to A0, BC0 to BC3
WR
t h(W-S)
t w(W)
t su(S-W)
t h(W-A)
t su(A-W)
t cW
t cR
相关PDF资料 |
PDF描述 |
|---|---|
| R5F64111DFB | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP100 |
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