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参数资料
| 型号： | R5F71243D50FP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP48 |
| 封装： | 10 X 10 MM, 0.65 MM PITCH, PLASTIC, LQFP-48 |
| 文件页数： | 433/595页 |
| 文件大小： | 4787K |
| 代理商： | R5F71243D50FP |
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Section 12 DDR-SDRAM Interface (DDRIF)
Rev.1.00 Dec. 13, 2005 Page 440 of 1286
REJ09B0158-0100
12.7
Usage Notes
12.7.1
Operating Frequency
The DDRIF supports ratios of 5:4 (DDR320) and 1:1 (DDR266) between the frequencies of the
SuperHyway clock (SHck) and DDR clock (DDRck). For details, see section 15, Clock Pulse
Generator (CPG). The maximum operating frequency of the SuperHyway clock is 200 MHz. The
minimum operating frequency depends on the frequency of the DDR-SDRAM clock. Therefore,
see the datasheet for the DDR-SDRAM.
12.7.2
Stopping Clock
Supply of the clock signal for the DDRIF stops in the following two cases:
when the SDRAM is in battery backup mode; and
when the PLL multiplication ratio or bus-clock frequency-division ratio is changed by the
frequency change register (FRQCR) of the CPG.
Since the clock signal is not being supplied in the above situations, auto-refreshing does not
proceed. Since the refresh cycle is not being maintained, data in the SDRAM will be lost. To
prevent this, software should place the SDRAM in the self-refresh state before supply of the clock
signal is stopped. For details on making the SDRAM enter and leave the self-refresh mode, see
section 12.5.5 (1), Self-Refresh Mode.
12.7.3
Using SCR to Issue REFA Command (Outside the Initialization Sequence)
The DDR-SDRAM bank is automatically opened by the DDRIF access (read from or written to).
When the REFA (auto-refresh) command is issued by using the SMS bits in SCR, be sure to close
the bank by using the SMS bits in SCR to issue the PREALL command. The same operation is
necessary when the SCR register setting is used to issue a REFA command for refreshing all rows
in the memory before starting up auto-refresh operations.
12.7.4
Timing of Connected SDRAM
The DDRIF only supports memory in which the number of cycles (tRAP) required from issuing an
ACT command to issuing a read with auto-precharge or write with auto-precharge command and
the number of cycles (tRCD) required from issuing an ACT command to issuing a read or write
command are the same. If the two numbers differ, the SDRAM should be accessed in bank open
mode.
相关PDF资料 |
PDF描述 |
|---|---|
| R5F71242N50FP | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP48 |
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参数描述 |
|---|---|
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