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参数资料
| 型号： | R80186 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 8 MHz, MICROPROCESSOR, CQCC68 |
| 封装： | CERAMIC, LCC-68 |
| 文件页数： | 8/33页 |
| 文件大小： | 372K |
| 代理商： | R80186 |
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8018680188
AC CHARACTERISTICS (TA e 0 Cto a70 C VCC e 5V g10%)
Timing Requirements
All Timings Measured At 15V Unless Otherwise Noted
Symbol
Parameter
8 MHz
10 MHz
Units
Conditions
Test
Min
Max
Min
Max
TDVCL
Data in Setup (AD)
20
15
ns
TCLDX
Data in Hold (AD)
10
8
ns
TARYHCH
Asynchronous Ready
20
15
ns
(ARDY) Active Setup
Time(1)
TARYLCL
ARDY Inactive Setup Time
35
25
ns
TCLARX
ARDY Hold Time
15
ns
TARYCHL
Asynchronous Ready
15
ns
Inactive Hold Time
TSRYCL
Synchronous Ready (SRDY)
20
ns
Transition Setup Time(2)
TCLSRY
SRDY Transition Hold
15
ns
Time(2)
THVCL
HOLD Setup(1)
25
20
ns
TINVCH
INTR NMI TEST TIM IN
25
ns
Setup(1)
TINVCL
DRQ0 DRQ1 Setup(1)
25
20
ns
Master Interface Timing Responses
TCLAV
Address Valid Delay
5
55
5
44
ns
CL e 20 pF–200 pF
all Outputs
TCLAX
Address Hold
10
ns
(Except TCLTMV)
8 MHz and 10 MHz
TCLAZ
Address Float Delay
TCLAX
35
TCLAX
30
ns
TCHCZ
Command Lines Float Delay
45
40
ns
TCHCV
Command Lines Valid Delay
55
45
ns
(after Float)
TLHLL
ALE Width
TCLCLb35
TCLCLb30
ns
TCHLH
ALE Active Delay
35
30
ns
TCHLL
ALE Inactive Delay
35
30
ns
TLLAX
Address Hold from ALE
TCHCLb25
TCHCLb20
ns
Inactive
TCLDV
Data Valid Delay
10
44
10
40
ns
TCLDOX
Data Hold Time
10
ns
TWHDX
Data Hold after WR
TCLCLb40
TCLCLb34
ns
TCVCTV
Control Active Delay 1
5
50
5
40
ns
TCHCTV
Control Active Delay 2
10
55
10
44
ns
TCVCTX
Control Inactive Delay
5
55
5
44
ns
TCVDEX
DEN Inactive Delay
10
70
10
56
ns
(Non-Write Cycle)
1 To guarantee recognition at next clock
2 To guarantee proper operation
16
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PDF描述 |
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