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参数资料
| 型号： | R8C23 |
| 厂商： | Renesas Technology Corp. |
| 英文描述： | MCU |
| 中文描述： | 微控制器 |
| 文件页数： | 10/52页 |
| 文件大小： | 471K |
| 代理商： | R8C23 |
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R8C/22 Group, R8C/23 Group
2. Central Processing Unit (CPU)
Rev.1.10 Mar 16, 2007
REJ03B0097-0110
Page 10 of 48
2.
Central Processing Unit (CPU)
Figure 2.1 shows the CPU Registers. The CPU contains 13 registers. Of these, R0, R1, R2, R3, A0, A1, and FB
comprise a register bank. Two sets of register banks are provided.
Figure 2.1
CPU Registers
R2
R3
b31
b15
R0H (high-order of R0)
b8b7
b0
Data registers
(1)
Address registers
(1)
R2
R3
A0
A1
FB
INTBH
b15
b19
b0
INTBL
Frame bass registers
(1)
The 4-high order bits of INTB are INTBH and
the 16-low order bits of INTB are INTBL.
Interrupt table register
b19
b0
USP
ISP
SB
Program counter
User stack pointer
Interrupt stack pointer
Static base register
PC
FLG
Flag register
Carry flag
Debug flag
Zero flag
Sign flag
Register bank select flag
Overflow flag
Interrupt enable flag
Stack pointer select flag
Reserved area
Processor interrupt priority level
Reserved area
C
IPL
D
Z
S
B
O
I
U
b15
b0
b15
b0
b15
b0
b8
b7
NOTE:
1. A register bank comprises these registers. Two sets of register banks are provided.
R0L (low-order of R0)
R1H (high-order of R1) R1L (low-order of R1)
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