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参数资料
| 型号： | S5N8947X |
| 厂商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | MCU for ADSL/Cable Modem |
| 中文描述： | 单片机为ADSL / Cable Modem的 |
| 文件页数： | 39/49页 |
| 文件大小： | 407K |
| 代理商： | S5N8947X |
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ELECTRONICS
S5N8947 (ADSL/Cable Modem MCU)
SAMSUNG ELECTRONICS
Page : 39
MagIC Team
8.4. A.C Electrical Characteristics
(Ta = -40 to +85 Centigrade, V
DD
= 2.3V to 2.7V)
Description
Memory control signal High-Z time
Signal Name
t
EMz
t
EMRs
t
EMRh
t
EMAr
t
EMAf
t
ADDRh
t
ADDRd
t
NRCS
t
NROE
t
NWBE
t
RDh
t
WDd
t
WDh
t
NRASf
t
NRASr
t
NCASf
t
NCASr
t
NDWE
t
NDOE
t
NECS
t
WDDd
t
WDDh
t
Ws
t
Wh
T
MCLKOd
Min
Max
Unit
5.1
10.1
ns
ExtMREQ setup time
0
ExtMREQ hold time
3.0
ExtMACK rising edge delay time
12.1
29.3
ExtMACK falling edge delay time
12.3
29.7
Address hold time
8.5
Address delay time
7.08
17.5
ROM/SRAM/Flash bank chip select delay time
5.2
12.4
ROM/SRAM or external I/O bank output enable delay
5.7
13.6
ROM/SRAM or external I/O bank write byte enable delay
5.5
13.1
Read data hold time
3.0
Write data delay time (SRAM or external I/O)
17.23
Write data hold time (SRAM or external I/O)
9.4
DRAM row address strobe active delay
5.6
13.4
DRAM row address strobe release delay
4.3
16.38
DRAM column address strobe active delay
5.5
13.1
DRAM CAS signal release delay time
4.36
13.1
DRAM bank write enable delay time
5.8
13.9
DRAM bank out enable delay time
5.7
13.6
External I/O bank chip select delay time
5.3
12.5
DRAM write data delay time (DRAM)
5.9
14.2
DRAM write data hold time (DRAM)
7.4
External wait setup time
0
External wait hold time
3.0
External clock to MCLKO delay time when PLL power-down
5.0
12.45
Table 7 AC Electrical Characteristics
相关PDF资料 |
PDF描述 |
|---|---|
| S5N8950 | G.dmt ADSL Transceiver for CO and CPE |
| S5N8951 | G.dmt ADSL Analog Front End IC |
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参数描述 |
|---|---|
| S5N8950 | 制造商:SAMSUNG 制造商全称:Samsung semiconductor 功能描述:G.dmt ADSL Transceiver for CO and CPE |
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