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参数资料
| 型号： | S71PL129JB0BAW9B0 |
| 厂商： | SPANSION LLC |
| 元件分类： | 存储器 |
| 英文描述： | Stacked Multi-Chip Product (MCP) Flash Memory |
| 中文描述： | SPECIALTY MEMORY CIRCUIT, PBGA64 |
| 封装： | 8 X 11.60 MM, 1.20 MM HEIGHT, LEAD FREE, FBGA-64 |
| 文件页数： | 18/149页 |
| 文件大小： | 2693K |
| 代理商： | S71PL129JB0BAW9B0 |
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18
S29PL129J for MCP
S29PL129J_MCP_00_A0 June 4, 2004
A d v a n c e I n f o r m a t i o n
Pin Description
Amax–A0
DQ15–DQ0
CE#
OE#
WE#
V
SS
NC
RY/BY#
=
=
=
=
=
=
=
=
Address bus
16-bit data inputs/outputs/float
Chip Enable Inputs
Output Enable Input
Write Enable
Device Ground
Pin Not Connected Internally
Ready/Busy output and open drain.
When RY/BY#= V
IH
, the device is ready to accept
read operations and commands. When RY/BY#=
V
OL
, the device is either executing an embedded
algorithm or the device is executing a hardware
reset operation.
Write Protect/Acceleration Input.
When WP#/ACC= V
IL
, the highest and lowest two
4K-word sectors are write protected regardless of
other sector protection configurations. When WP#/
ACC= V
IH
, these sector are unprotected unless the
DYB or PPB is programmed. When WP#/ACC= 12V,
program and erase operations are accelerated.
Input/Output Buffer Power Supply 2.7 V to 3.6 V
Chip Power Supply
(2.7 V to 3.6 V or 2.7 to 3.3 V)
Hardware Reset Pin
Chip Enable Inputs.
CE1# controls the 64Mb in Banks 1A and 1B. CE2#
controls the 64 Mb in Banks 2A and 2B.
WP#/ACC
=
V
IO
V
CC
=
=
RESET#
CE1#, CE2#
=
=
Notes:
1.
Amax = A21
Logic Symbol
max+ 1
16
DQ15–DQ0
Amax–A0
CE#
OE#
WE#
RESET#
RY/BY#
WP#/ACC
V
IO
(V
CCQ
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PDF描述 |
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