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参数资料
| 型号： | SAF-XC886C-8FFI3V3 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP48 |
| 封装： | PLASTIC, TQFP-48 |
| 文件页数： | 78/144页 |
| 文件大小： | 1455K |
| 代理商： | SAF-XC886C-8FFI3V3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页当前第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页
XC886/888CLM
Functional Description
Data Sheet
32
V1.2, 2009-07
3.2.4.2
MDU Registers
The MDU SFRs can be accessed in the mapped memory area (RMAP = 1).
A8H
IEN0
Reset: 00H
Interrupt Enable Register 0
Bit Field
EA
0
ET2
ES
ET1
EX1
ET0
EX0
Type
rw
r
rwrw
rw
rwrw
B8H
IP
Reset: 00H
Interrupt Priority Register
Bit Field
0
PT2
PS
PT1
PX1
PT0
PX0
Type
r
rwrw
rw
rwrw
B9H
IPH
Reset: 00H
Interrupt Priority High Register
Bit Field
0
PT2H
PSH
PT1H
PX1H
PT0H
PX0H
Type
r
rwrw
rw
rwrw
D0H
PSW
Reset: 00H
Program Status Word Register
Bit Field
CY
AC
F0
RS1
RS0
OV
F1
P
Type
rwh
rw
rwh
rw
rh
E0H
ACC
Reset: 00H
Accumulator Register
Bit Field
ACC7
ACC6
ACC5
ACC4
ACC3
ACC2
ACC1
ACC0
Type
rw
E8H
IEN1
Reset: 00H
Interrupt Enable Register 1
Bit Field
ECCIP
3
ECCIP
2
ECCIP
1
ECCIP
0
EXM
EX2
ESSC
EADC
Type
rw
F0H
B
Reset: 00H
B Register
Bit Field
B7
B6
B5
B4
B3
B2
B1
B0
Type
rw
F8H
IP1
Reset: 00H
Interrupt Priority 1 Register
Bit Field
PCCIP
3
PCCIP
2
PCCIP
1
PCCIP
0
PXM
PX2
PSSC
PADC
Type
rw
F9H
IPH1
Reset: 00H
Interrupt Priority 1 High Register
Bit Field
PCCIP
3H
PCCIP
2H
PCCIP
1H
PCCIP
0H
PXMH
PX2H
PSSC
H
PADC
H
Type
rw
Table 6
MDU Register Overview
Addr Register Name
Bit
7
6
5
4
3
2
1
0
RMAP = 1
B0H
MDUSTAT
Reset: 00H
MDU Status Register
Bit Field
0
BSY
IERR
IRDY
Type
r
rh
rwh
B1H
MDUCON
Reset: 00H
MDU Control Register
Bit Field
IE
IR
RSEL
STAR
T
OPCODE
Type
rw
rwh
rw
B2H
MD0
Reset: 00H
MDU Operand Register 0
Bit Field
DATA
Type
rw
B2H
MR0
Reset: 00H
MDU Result Register 0
Bit Field
DATA
Type
rh
B3H
MD1
Reset: 00H
MDU Operand Register 1
Bit Field
DATA
Type
rw
Table 5
CPU Register Overview (cont’d)
Addr Register Name
Bit
7
6
5
4
3
2
1
0
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PDF描述 |
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参数描述 |
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