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参数资料
| 型号： | SAF-XE164K-48F66L |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封装： | 0.50 MM PITCH, GREEN, PLASTIC, LQFP-100 |
| 文件页数： | 3/113页 |
| 文件大小： | 1498K |
| 代理商： | SAF-XE164K-48F66L |
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XE164x
XE166 Family Derivatives
Electrical Parameters
Preliminary
Data Sheet
98
V2.0, 2008-03
Table 29
External Bus Cycle Timing for Lower Voltage Range
(Operating Conditions apply)
Parameter
Symbol
Limits
Unit Note
Min.
Typ.
Max.
Output valid delay for:
RD, WR(L/H)
t
10 CC
–
20
ns
Output valid delay for:
BHE, ALE
t
11 CC
–
20
ns
Output valid delay for:
A23 … A16, A15 … A0 (on P0/P1)
t
12 CC
–
22
ns
Output valid delay for:
A15 … A0 (on P2/P10)
t
13 CC
–
22
ns
Output valid delay for:
CS
t
14 CC
–
20
ns
Output valid delay for:
D15 … D0 (write data, MUX-mode)
t
15 CC
–
21
ns
Output valid delay for:
D15 … D0 (write data, DEMUX-
mode)
t
16 CC
–
21
ns
Output hold time for:
RD, WR(L/H)
t
20 CC
0
10
ns
Output hold time for:
BHE, ALE
t
21 CC
0
10
ns
Output hold time for:
A23 … A16, A15 … A0 (on P2/P10)
t
23 CC
0
10
ns
Output hold time for:
CS
t
24 CC
0
10
ns
Output hold time for:
D15 … D0 (write data)
t
25 CC
0
10
ns
Input setup time for:
READY, D15 … D0 (read data)
t
30 SR
29
–
ns
Input hold time for:
READY, D15 … D0 (read data)1)
1) Read data are latched with the same internal clock edge that triggers the address change and the rising edge
of RD. Address changes before the end of RD have no impact on (demultiplexed) read cycles. Read data can
change after the rising edge of RD.
t
31 SR
-6
–
ns
相关PDF资料 |
PDF描述 |
|---|---|
| SAK-XC2236N-24F80L | 16-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP64 |
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| SBBGMEBGA99W | T1-1/2 TRIPLE COLOR LED, RED/GREEN/BLUE, 4 mm |
| SBC23-11EGWA | 7 SEG NUMERIC DISPLAY, HIGH EFFICIENCY RED/GREEN, 56.9 mm |
相关代理商/技术参数 |
参数描述 |
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