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参数资料
| 型号： | SAK-XC2230L-12F80L |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP64 |
| 封装： | 0.50 MM PITCH, GREEN, PLASTIC, LQFP-64 |
| 文件页数： | 4/113页 |
| 文件大小： | 3160K |
| 代理商： | SAK-XC2230L-12F80L |
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XC2230L, XC2234L
XC2000 Family / Econo Line
Electrical Parameters
PRELIMINARY
Data Sheet
97
V1.0, 2010-12
4.6.6
Debug Interface Timing
The debugger can communicate with the XC223[04]L via 1-pin SPD interface, via the 2-
pin DAP interface or via the standard JTAG interface.
Debug via DAP
The following parameters are applicable for communication through the DAP debug
interface.
Note: These parameters are not subject to production test but verified by design and/or
characterization.
Note: Operating Conditions apply.
Table 34 is valid under the following conditions:
C
L= 20 pF; voltage_range= upper
Table 34
DAP Interface Timing for Upper Voltage Range
Parameter
Symbol
Values
Unit Note /
Test Condition
Min.
Typ.
Max.
DAP0 clock period
t
11 SR
1001)
1) The debug interface cannot operate faster than the overall system, therefore
t11 ≥ tSYS.
ns
DAP0 high time
t
12 SR
8
ns
DAP0 low time
t
13 SR
8
ns
DAP0 clock rise time
t
14 SR
4ns
DAP0 clock fall time
t
15 SR
4ns
DAP1 setup to DAP0
rising edge
t
16 SR
6
ns
pad_type= stan
dard
DAP1 hold after DAP0
rising edge
t
17 SR
6
ns
pad_type= stan
dard
DAP1 valid per DAP0
clock period2)
2) The Host has to find a suitable sampling point by analyzing the sync telegram response.
t
19 CC
92
95
ns
pad_type= stan
dard
相关PDF资料 |
PDF描述 |
|---|---|
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| SAK-XC2264-56F66L | 32-BIT, FLASH, 66 MHz, MICROCONTROLLER, PQFP100 |
| SAF-XC2387-72F66L | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PQFP144 |
| SAF-XC2735X-72F80L | RISC MICROCONTROLLER, PQFP64 |
相关代理商/技术参数 |
参数描述 |
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