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参数资料
| 型号： | SG6961DZ |
| 厂商： | Fairchild Semiconductor |
| 文件页数： | 7/14页 |
| 文件大小： | 835K |
| 描述： | IC PWM CTLR PFC/FORWARD 8-DIP |
| 标准包装： | 59 |
| 模式： | 平均电流 |
| 频率 - 开关： | 50kHz |
| 电流 - 启动： | 10µA |
| 电源电压： | 12 V ~ 20 V |
| 工作温度： | -20°C ~ 125°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 8-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 8-DIP |
| 包装： | 管件 |
?2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
SG6961 " Rev. 1.3.2
7
Electrical Characteristics
V
CC
=15V, T
A
=25癈, unless otherwise specified.
Symbol
Parameter
Conditions
Min.
Typ.
Max.
Units
Current-Sense Section
V
PK
Threshold Voltage for
Peak Current Limit Cycle-
by-Cycle Limit
0.77
0.82
0.87
V
t
PD
Propagation Delay
200
ns
t
LEB
Leading-Edge Blanking
Time
R
MOT
=24k&
400
500
ns
Gate Section
V
ZOUT
Output Voltage Maximum
(Clamp)
V
CC
=20V
15.5
16.5
17.5
V
V
OL
Output Voltage Low
V
CC
=15V, I
O
=100mA
1.4
V
V
OH
Output Voltage High
V
CC
=14V, I
O
=100mA
8
V
t
R
Rising Time
VCC=12V, CL=3nF,
20~80%
50
80
160
ns
tF
Falling Time
V
CC
=12V, C
L
=3nF,
80~20%
30
40
70
Zero Current Detection Section
V
ZCD
Input Threshold Voltage
Rising Edge
V
ZCD
Increasing
1.9
2.1
2.3
V
H
YS
of V
ZCD
Threshold Voltage
Hysteresis
V
ZCD
Decreasing
0.25
0.35
0.50
V
V
ZCD-HIGH
Upper Clamp Voltage
I
ZCD
=3mA
8
10
12
V
V
ZCD-LOW
Lower Clamp Voltage
I
ZCD
=-0.5mA
0
V
t
DEAD
Maximum Delay, ZCD to
Output Turn-On
V
COMP
=5V, f
SW
=60KHz
100
400
ns
t
RESTART
Restart Time
Output Turned Off by ZCD
300
500
700
約
t
INHIB
Inhibit Time (Maximum
Switching Frequency
Limit)
R
MOT
=24k&
1.5
2.5
3.0
約
V
DIS
Disable Threshold Voltage
200
250
300
mV
t
ZCD-DIS
Disable Function
Debounce Time
R
MOT
=24k&, V
ZCD
=100mV
800
約
Maximum On-Time Section
V
MOT
Maximum On Time
Voltage
1.25
1.30
1.35
V
t
ON-MAX
Maximum On Time
Programming
(Resistor Based)
RMOT=24k&, VCS=0V,
V
COMP
=5V
21
25
27
約
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PDF描述 |
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参数描述 |
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