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参数资料
| 型号： | SI51211-A01AFM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 1/12页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN FACTORY CONFIG 8TDFN |
| 标准包装： | 100 |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:3 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.375 V ~ 3.63 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-WFDFN 裸露焊盘 |
| 供应商设备封装： | 8-TDFN（1.4x1.6） |
| 包装： | 管件 |
Preliminary Rev. 0.7 1/12
Copyright 2012 by Silicon Laboratories
Si51211
This information applies to a product under development. Its characteristics and specifications are subject to change without notice.
Si51211
T HREE O UTPUTS F ACTORY P ROGRAMMABLE C LOCK
G ENERATOR
Features
Applications
Description
The factory programmable Si51211 is a low power, small footprint and
frequency flexible programmable clock generator targeting low power, low
cost and high volume consumer and embedded applications. The device
operates from a single crystal or an external clock source and generates
1 to 3 outputs up to 200 MHz. They are factory programmed to provide
customized output frequencies, control inputs and ac parameter tuning
like output drive strength that are optimized for customer board condition
and application requirements. A separate VDDO supply pin supports
clock output at a different voltage level.
Functional Block Diagram
Generates up to 3 CMOS clock
outputs from 3 to 200 MHz
Accepts crystal or reference
clock input
3 to 166 MHz reference clock input
8 to 48 MHz crystal input
Programmable FSEL, SSEL,
SSON, PD, and OE input
functions
Low power dissipation
Separate voltage supply pins
VDD = 2.5 to 3.3 V
VDDO= 1.8 to 3.3 V (VDDO ≤ VDD)
0.25% to 1.0% Spread Spectrum
(Center Spread)
Low cycle-cycle jitter
Programmable output rise and
fall times
Ultra small 8-pin TDFN package
(1.4 x 1.6 mm)
Crystal/XO replacement
EMI reduction
Portable devices
Digital still camera
IP phone
Smart meter
2
3
1
5
4
6
To Pin 4 and Pin 6
To Core
Programmable
Configuration
Register
PLL with
Modulation
Control
Buffers,
Dividers,
and
Switch
Matrix
SSCLK1/
REFCLK/
0E2/FSEL/
SSEL/SS0N
SSCLK2/
REFCLK_D
0E1/FSEL/
SSEL/SS0N/PD
XIN/
CLKIN
XOUT
VDD
VSS
V-REG
8
VDD0
To Pin 7
7 SSCLK3 (VDD0)
Patents pending
Ordering Information:
See page 9.
Pin Assignments
8
7
6
5
1
2
3
4
VDDO
SSCLK3
SSCLK2/REFCLK_D
FSEL/SSEL/SSON/
PD/OE1
VSS
VDD
XOUT
XIN/CLKIN
SSCLK1/REFCLK
FSEL/SSEL/SSON/
OE2
Si51211
相关PDF资料 |
PDF描述 |
|---|---|
| SI51214-A01AFM | IC CLK GEN FACTORY CONFIG 6TDFN |
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| SI5316-B-GM | IC PREC JITTER ATTENUATOR 36QFN |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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