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参数资料
| 型号： | SL28541BZC-2 |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 12/28页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK CK505 MOBILE 56TSSOP |
| 标准包装： | 35 |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | Intel CPU 服务器 |
| 输入： | 时钟，晶体 |
| 输出： | HCSL，LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:21 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
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SL28541-2
........................ DOC #: SP-AP-0064 (Rev. AB) Page 2 of 28
56 TSSOP Pin Definition
Pin No.
Name
Type
Description
1
PCI0/OE#_0/2_A
I/O, SE 3.3V, 33MHz clock/3.3V OE# Input mappable via I2C to control either SRC0 or
SRC2. (Default PCI0, 33MHz clock)
2
VDD_PCI
PWR
3.3V Power supply for PCI PLL.
3
PCI1/OE#_1/4_A
I/O, SE 3.3V, 33MHz clock/3.3V OE# Input mappable via I2C to control either SRC1 or
SRC4. (Default PCI1, 33MHz clock)
4
PCI2/TME
I/O, SE 3.3V tolerance input for overclocking enable pin/3.3V, 33MHz clock.
(Refer to DC Electrical Specifications table for Vil_FS and Vih_FS specifications)
5
PCI3
O, SE, 33 MHz clock.
6
PCI4 / GCLK_SEL
I/O, SE 33 MHz clock output/3.3V-tolerant input for selecting graphic clock source on pin
13, 14, 17and 18
Sampled on CKPWRGD assertion
7
PCIF_0/ITP_EN
I/O, SE 3.3V LVTTL input to enable SRC8 or CPU2_ITP/33 MHz clock output. (sampled
on the CK_PWRGD assertion)
1 = CPU2_ITP, 0 = SRC8
8
VSS_PCI
GND
Ground for outputs.
9
VDD_48
PWR
3.3V Power supply for outputs and PLL.
10
USB_48/FSA
I/O
3.3V tolerant input for CPU frequency selection/fixed 3.3V, 48MHz clock output.
(Refer to DC Electrical Specifications table for Vil_FS and Vih_FS specifications)
11
VSS_48
GND
Ground for outputs.
12
VDD_IO
PWR
0.7V Power supply for outputs.
13
SRC0/DOT96
O, DIF 100MHz Differential serial reference clocks/Fixed 96MHz clock output.
(Selected via I2C default is SRC0)
14
SRC0#/DOT96#
O, DIF 100MHz Differential serial reference clocks/Fixed 96MHz clock output.
(Selected via I2C default is SRC0)
15
VSS_IO
GND
Ground for PLL2.
16
VDD_PLL3
PWR
3.3V Power supply for PLL3
17
SRC1/LCD100/27_NSS
O, DIF,
SE
True 100 MHz differential serial reference clock output/True 100 MHz LCD video
clock output / Non-spread 27-MHz video clock output.
Selected via GCLK_SEL at CKPWRGD assertion.
18
SRC1#/LCD100#/27_SS
O, DIF,
SE
Complementary 100 MHz differential serial reference clock output/Complementary
100 MHz LCD video clock output /Spread 27 MHz video clock output.
Selected via GCLK_SEL at CKPWRGD assertion.
19
VSS_PLL3
GND
Ground for PLL3.
20
VDD_PLL3_IO
PWR
IO Power supply for PLL3 outputs.
21
SRC2/SATA
O, DIF 100MHz Differential serial reference clocks.
22
SRC2#/SATA#
O, DIF 100MHz Differential serial reference clocks.
23
VSS_SRC
GND
Ground for outputs.
24
SRC3/OE#_0/2_B
I/O,
Dif
100MHz Differential serial reference clocks / 3.3V OE#_0/2_B, input, mappable via
I2C to control either SRC0 or SRC2. (Default SRC3, 100MHz clock)
25
SRC3#OE#_1/4_B
I/O,
Dif
100MHz Differential serial reference clocks / 3.3V OE#_1/4_B input, mappable via
I2C to control either SRC1 or SRC4. (Default SRC3, 100MHz clock)
26
VDD_SRC_IO
PWR
IO power supply for SRC outputs.
GCLK_SEL
Pin13
Pin14
Pin17
Pin 18
0
DOT96T DOT96C SRC1T/LCD_100T SRC1C/LCD_100C
1
SRCT0
SRCC0
27M_NSS
27M_SS
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PDF描述 |
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参数描述 |
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| SL28541BZI-2T | 功能描述:时钟发生器及支持产品 Montevina, Atom RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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