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参数资料
型号： SL28610BLIT
厂商： Silicon Laboratories Inc
文件页数： 12/23页
文件大小： 0K
描述： IC CLK ATOM POULSBO PCIE 48QFN
标准包装： 2,500
类型： 时钟/频率发生器，多路复用器
PLL： 是
主要目的： Intel CPU 服务器
输入： 时钟，晶体
输出： HCSL，LVCMOS
电路数： 1
比率 - 输入:输出： 1:9
差分 - 输入:输出： 无/是
频率 - 最大： 200MHz
电源电压： 3.135 V ~ 3.465 V
工作温度： -40°C ~ 85°C
安装类型： *
封装/外壳： *
供应商设备封装： *
包装： *
SL28610
........................ DOC #: SP-AP-0078 (Rev. 1.0) Page 2 of 23
Pin Definitions
Pin No.
Name
Type
Description
1
CPU_STP#
I, SE
3.3V input for CPU_STP# (active low) functionality
2
CKPWRGD#/PD
I, SE
3.3V LVTTL input (active low)
3
XOUT
O, SE 3.3V, 14.31818MHz crystal output (When used a clock input, float XOUT)
4
XIN/CLKIN
I, SE
3.3V, 14.31818MHz crystal input, 3.3V Clock Input.
5
VDD3.3V
PWR
3.3V power supply for single-ended clock
6
REF / PCIe_SEL
IO, PD,
SE
3.3V, 14.31818MHz output / 1.5V input active high signal latched on CKPWRGD#
signal to select PCIe from PLL3 (share with LCD PLL; 100K-ohm internal pull-down)
7
VSS
GND
Ground
8
VDD1.5_CORE
PWR
1.5V power supply for core
9
FSC
I, SE
1.05V Frequency Select C
10
TEST_MODE
I, SE
3.3V-tolerant input to selects Ref/N or Tri-state when in test mode.
0 = Tri-state, 1 = Ref/N
11
TEST_SEL
I, SE
3.3V-tolerant input to selects TEST_SEL
0 = Normal, 1 = Test Entry
12
SCLK
I, SE
3.3V SMBus Clock Line
13
SDATA
I/O, SE 3.3V SMBus Data Line
14
VDD1.5_CORE
PWR
1.5V power supply for core
15
VDD1.5_IO
PWR
1.5V power supply for differential outputs
16
DOT96#
O, DIFF Fixed complimentary 96MHz clock output
17
DOT96
O, DIFF Fixed true 96MHz clock output
18
VSS
GND
Ground
19
VSS
GND
Ground
20
LCD_SSC#
O, DIF Complementary 100MHz Differential clock
21
LCD_SSC
O, DIF True 100MHz Differential clock
22
VDD1.5_IO
PWR
1.5V power supply for differential outputs
23
VDD1.5_CORE
PWR
1.5V power supply for core
24
OE_0#
I, SE
Output enable for PCIe0, (10K-ohm internal pull-up)
0 =enable, 1=disable
25
VSS
GND
Ground
26
PCIe0#
O, DIF Complementary 100MHz Differential clock
27
PCIe0
O, DIF True 100MHz Differential clock
28
OE_1#
I, SE
Output enable for PCIe1, (10K-ohm internal pull-up)
0 =enable, 1=disable
29
VDD1.5_CORE
PWR
1.5V Power Supply for core
30
VDD1.5_IO
PWR
1.5V Power Supply for differential output
31
PCIe1#
O, DIF Complementary 100MHz Differential clock
32
PCIe1
O, DIF True 100MHz Differential clock
33
VSS
GND
Ground
34
PCIe2#
O, DIF Complementary 100MHz Differential clock
35
PCIe2
O, DIF True 100MHz Differential clock
36
OE_2#
I, SE
Output enable for PCIe2, (10K-ohm internal pull-up)
0 =enable, 1=disable
37
FSB
I, SE
1.05V Frequency Select B
38
CPU0#
O, DIF Complementary Host Differential clock
39
CPU0
O, DIF True Host Differential clock
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PDF描述
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参数描述
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SL28647BLC 功能描述:时钟发生器及支持产品 Montevina RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56
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