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参数资料
| 型号： | SL28779CLCT |
| 厂商： | SILICON LABORATORIES |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 133 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC32 |
| 封装： | 5 X 5 MM, ROHS COMPLIANT, QFN-32 |
| 文件页数： | 18/22页 |
| 文件大小： | 286K |
| 代理商： | SL28779CLCT |
SL28779
DOC#: SP-AP-0066 (Rev. AA)
Page 5 of 22
Control Registers
Byte 0: Control Register 0
Bit
@Pup
Name
Description
7
HW
FS
CPU Frequency Select Bit, set by HW
0 = 133MHz, 1= 100MHz
6
0
RESERVED
5
1
RESERVED
4
0
iAMT_EN
iAMT Enable
0 = Legacy Mode, 1 = iAMT Enabled
3
0
RESERVED
2
0
SRC_Main_SEL
Select source for SRC clock
0 = SRC_MAIN = PLL1, PLL3_CFG Table applies
1 = SRC_MAIN = PLL3, PLL3_CFG Table does not apply
1
0
SATA_SEL
Select source of SATA clock
0 = SATA = SRC_MAIN, 1= SATA = PLL4
0
1
PD_Restore
Save configuration when PD# is asserted
0 = Config. cleared, 1 = Config. saved
Byte 1: Control Register 1
Bit
@Pup
Name
Description
7
1
RESERVED
6
0
PLL1_SS_DC
Select for down or center SS
0 = Down spread, 1 = Center spread
5
0
PLL3_SS_DC
Select for down or center SS
0 = Down spread, 1 = Center spread
4
0
PLL3_CFB3
CFB Bit [4:1] only applies when SRC_Main_SEL = 0 (Byte 0, bit 2 =0)
See Table 4 on page 9 for Configuration.
3
0
PLL3_CFB2
2
1
PLL3_CFB1
1
0
PLL3_CFB0
0
1
RESERVED
Byte 2: Control Register 2
Bit
@Pup
Name
Description
7
1
REF_OE
Output enable for REF
0 = Output Disabled, 1 = Output Enabled
6
1
USB_48_OE
Output enable for USB_48
0 = Output Disabled, 1 = Output Enabled
5
1
RESERVED
4
1
RESERVED
3
1
RESERVED
2
1
RESERVED
1
RESERVED
0
1
RESERVED
Byte 3: Control Register 3
Bit
@Pup
Name
Description
7
1
RESERVED
6
1
RESERVED
相关PDF资料 |
PDF描述 |
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参数描述 |
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| SL28779ELCT | 功能描述:时钟发生器及支持产品 Calpella IrnLk JpFrt Ibex Pk Add USB28748 RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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