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参数资料
| 型号： | SL28PCIE25ALI |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 11/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK PCIE GEN3/2 32QFN |
| 标准包装： | 624 |
| 系列： | EProClock® |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:5 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 100MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
SL28PCIe25
DOC#: SP-AP-0776 (Rev. 0.2)
Page 4 of 16
Control Registers
19
Acknowledge from slave
19
Acknowledge from slave
27:20
Data byte–8 bits
20
Repeated start
28
Acknowledge from slave
27:21
Slave address–7 bits
29
Stop
28
Read
29
Acknowledge from slave
37:30
Data from slave–8 bits
38
NOT Acknowledge
39
Stop
Byte 0: Control Register 0
Bit
@Pup
Name
Description
7
1
RESERVED
6
0
RESERVED
5
1
RESERVED
4
0
RESERVED
3
0
RESERVED
2
0
RESERVED
1
0
RESERVED
0
1
PD_Restore
Save configuration when PD# is asserted
0 = Config. cleared, 1 = Config. saved
Table 3. Byte Read and Byte Write Protocol
Byte 1: Control Register 1
Bit
@Pup
Name
Description
7
1
RESERVED
6
0
PLL1_SS_DC
Select for down or center SS
0 = -0.5% Down spread, 1 = +/-0.5% Center spread
5
0
RESERVED
4
0
RESERVED
3
0
RESERVED
2
1
RESERVED
1
0
RESERVED
0
1
RESERVED
Byte 2: Control Register 2
Bit
@Pup
Name
Description
7
1
REF_OE
Output enable for REF
0 = Output Disabled, 1 = Output Enabled
6
1
RESERVED
5
1
RESERVED
4
1
RESERVED
3
1
RESERVED
2
1
RESERVED
1
RESERVED
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| SL28PCIe26ALI | 功能描述:时钟发生器及支持产品 PCIE Clk Gen Xin 25M -->4 PCIE out Gen3 RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| SL28PCIe26ALIT | 功能描述:时钟发生器及支持产品 PCIE Clk Gen Xin 25M -->4 PCIE out Gen3 RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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