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参数资料
| 型号： | SMC032BFY6E |
| 厂商： | NUMONYX |
| 元件分类： | PROM |
| 英文描述： | 4M X 8 FLASH 3.3V PROM CARD, 300 ns, UUC50 |
| 封装： | LEAD FREE, CARD-50 |
| 文件页数： | 40/90页 |
| 文件大小： | 1863K |
| 代理商： | SMC032BFY6E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页当前第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页
SMCxxxBF
Software interface
8.4
I/O primary and secondary address configurations
When the system decodes the primary and secondary address configurations, the registers
are accessed in the block of I/O space as shown in Table 39.
As for the memory mapped addressing, register 0 is accessed with –CE1 Low and –CE2
Low (and A0 don’t care) as a word register on the combined odd and even data bus (D15 to
D0). This register may also be accessed with –CE1 Low and –CE2 High, by a pair of byte
accesses to offset 0. The address space of this word register overlaps the address space of
the error and feature byte-wide registers at offset 1. When accessed twice as byte register
with –CE1 Low, the first byte is the even byte of the word and the second is the odd byte. A
byte access to register 0 with –CE1 High and –CE2 Low accesses the error (read) or feature
(write) register.
Table 39.
Primary and secondary I/O decoding
–
REG
A9 to
A4
A3
A2
A1
A0
–
IORD=0
–
IOWR=0
0
1F(17)h
0
Even data register
0
1F(17)h
0
1
Error register
Feature register
0
1F(17)h
0
1
0
Sector count register
0
1F(17)h
0
1
Sector number register
0
1F(17)h
0
1
0
Cylinder low register
0
1F(17)h
0
1
0
1
Cylinder high register
0
1F(17)h
0
1
0
Select card/head register
0
1F(17)h
0
1
Status register
Command register
0
3F(37)h
0
1
0
Alternate status register
Device control register
0
3F(37)h
0
1
Drive address register
Reserved
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