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参数资料
| 型号： | SPAKXC16Z1VFC20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, MICROCONTROLLER, PQFP132 |
| 封装： | PLASTIC, SMT-132 |
| 文件页数： | 12/200页 |
| 文件大小： | 1383K |
| 代理商： | SPAKXC16Z1VFC20 |
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MC68HC16Z1
MOTOROLA
MC68HC16Z1TS/D
109
I4/O5 — Input Capture 4/Output Compare 5
0 = Output compare 5 enabled
1 = Input capture 4 enabled
PACLK[1:0] — Pulse Accumulator Clock Select (Gated Mode)
PACNT — Pulse Accumulator Counter
Eight-bit read/write counter used for external event counting or gated time accumulation.
TIC[1:3] — Input Capture Registers 1–3
$YFF90E, $YFF910, $YFF912
The input capture registers are 16-bit read-only registers which are used to latch the value of TCNT
when a specified transition is detected on the corresponding input capture pin. They are reset to $FFFF.
TOC[1:4] — Output Compare Registers 1–4
$YFF914, $YFF916, $YFF918, $YFF91A
The output compare registers are 16-bit read/write registers which can be used as output waveform
controls or as elapsed time indicators. For output compare functions, they are written to a desired match
value and compared against TCNT to control specified pin actions. They are reset to $FFFF.
TI4/O5 — Input Capture 4/Output Compare 5 Register
$YFF91C
This register serves either as input capture register 4 or output compare register 5, depending on the
state of I4/O5 in PACTL.
TCTL1 determines output compare mode and output logic level. TCTL2 determines the type of input
capture to be performed.
OM/OL[5:2] — Output Compare Mode Bits and Output Compare Level Bits
Each pair of bits specifies an action to be taken when output comparison is successful.
EDGE[4:1] — Input Capture Edge Control Bits
Each pair of bits configures input sensing logic for the corresponding input capture.
PACLK[1:0]
Pulse Accumulator Clock Selected
00
System Clock Divided by 512
01
Same Clock Used to Increment TCNT
10
TOF Flag from TCNT
11
External Clock, PCLK
TCTL1/TCTL2 — Timer Control Registers 1–2
$YFF91E
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
OM5
OL5
OM4
OL4
OM3
OL3
OM2
OL2
EDGE4
EDGE3
EDGE2
EDGE1
RESET:
0
OM/OL[5:2]
Action Taken
00
Timer Disconnected from Output Logic
01
Toggle OCx Output Line
10
Clear OCx Output Line to 0
11
Set OCx Output Line to 1
EDGE[4:1]
Configuration
00
Capture Disabled
01
Capture on Rising Edge Only
10
Capture on Falling Edge Only
11
Capture on Any (Rising or Falling) Edge
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