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参数资料
| 型号： | SPC5200CBV466B |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 466 MHz, MICROPROCESSOR, PBGA272 |
| 封装： | 27 X 27 MM, 1.27 MM PITCH, HALIDE FREE, PLASTIC, BGA-272 |
| 文件页数： | 44/80页 |
| 文件大小： | 788K |
| 代理商： | SPC5200CBV466B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页当前第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页
Electrical and Thermal Characteristics
MPC5200B Data Sheet, Rev. 0.6
Freescale Semiconductor
49
3.3.13 I2C
NOTE
Output timing is specified at a nominal 50 pF load.
Table 40. I2C Input Timing Specifications—SCL and SDA
Sym
Description
Min
Max
Units
SpecID
1
Start condition hold time
2
—
IP-Bus Cycle(1)
NOTES:
1
Inter Peripheral Clock is defined in the MPC5200B User Manual [1].
A13.1
2
Clock low time
8
—
IP-Bus Cycle(1)
A13.2
4
Data hold time
0.0
—
ns
A13.3
6
Clock high time
4
—
IP-Bus Cycle(1)
A13.4
7
Data setup time
0.0
—
ns
A13.5
8
Start condition setup time (for repeated start condition
only)
2
—
IP-Bus Cycle(1)
A13.6
9
Stop condition setup time
2
—
IP-Bus Cycle(1)
A13.7
Table 41. I2C Output Timing Specifications—SCL and SDA
Sym
Description
Min
Max
Units
SpecID
1(1)
NOTES:
1
Programming IFDR with the maximum frequency (IFDR=0x20) results in the minimum output timings listed. The
I2C interface is designed to scale the data transition time, moving it to the middle of the SCL low period. The actual
position is affected by the prescale and division values programmed in IFDR.
Start condition hold time
6
—
IP-Bus Cycle(3)
A13.8
2(1)
Clock low time
10
—
IP-Bus Cycle(3)
A13.9
3(2)
2
Because SCL and SDA are open-drain-type outputs, which the processor can only actively drive low, the time SCL
or SDA takes to reach a high level depends on external signal capacitance and pull-up resistor values
SCL/SDA rise time
—
7.9
ns
A13.10
4(1)
Data hold time
7
—
IP-Bus Cycle(3) A13.11
5(1)
SCL/SDA fall time
—
7.9
ns
A13.12
6(1)
Clock high time
10
—
IP-Bus Cycle(3) A13.13
7(1)
Data setup time
2
—
IP-Bus Cycle(3) A13.14
8(1)
Start condition setup time (for repeated start condition
only)
20
—
IP-Bus Cycle(3) A13.15
9(1)
Stop condition setup time
10
—
IP-Bus Cycle(3)
3
Inter Peripheral Clock is defined in the MPC5200B User Manual [1].
A13.16
相关PDF资料 |
PDF描述 |
|---|---|
| MPC5200CVR466B | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA272 |
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相关代理商/技术参数 |
参数描述 |
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| SPC5200CVR400BR2 | 功能描述:微处理器 - MPU HABANERO AUTO PB FREE RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| SPC5200CVR400R2 | 功能描述:IC MPU 32BIT 400MHZ 272-PBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - 微处理器 系列:MPC52xx 标准包装:2 系列:MPC8xx 处理器类型:32-位 MPC8xx PowerQUICC 特点:- 速度:133MHz 电压:3.3V 安装类型:表面贴装 封装/外壳:357-BBGA 供应商设备封装:357-PBGA（25x25） 包装:托盘 |
| SPC5200VVR266B | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:SDRAM/DDR Memory Controller |
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