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参数资料
| 型号： | SPC5604PGF0MLQ6 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 75/104页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 512KB FLASH 144LQFP |
| 标准包装： | 60 |
| 系列： | MPC56xx Qorivva |
| 核心处理器： | e200z0h |
| 芯体尺寸： | 32-位 |
| 速度： | 64MHz |
| 连通性： | CAN，FlexRay，LIN，SPI，UART/USART |
| 外围设备： | DMA，POR，PWM，WDT |
| 输入/输出数： | 108 |
| 程序存储器容量： | 512KB（512K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 64K x 8 |
| RAM 容量： | 40K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 30x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 144-LQFP |
| 包装： | 托盘 |
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MPC5604P Microcontroller Data Sheet, Rev. 8
Freescale
72
Eqn. 11
From this formula, in the worst case (when VA is maximum, that is for instance 5 V), assuming to accept a maximum error of
half a count, a constraint is evident on CF value:
Eqn. 12
3.14.2
ADC conversion characteristics
Table 31. ADC conversion characteristics
Symbol
C
Parameter
Conditions1
Value
Unit
Min
Typ
Max
VINAN0 SR
ADC0 and shared ADC0/1
analog input voltage2, 3
—VSS_HV_ADV
0
0.3
—VDD_HV_ADV
0
+ 0.3
V
VINAN1 SR
ADC1 analog input voltage2, 4
—VSS_HV_ADV
1
0.3
—VDD_HV_ADV
1
+ 0.3
V
fCK
SR — ADC clock frequency (depends
on ADC configuration)
(The duty cycle depends on
AD_clk5 frequency)
—36
—60
MHz
fs
SR — Sampling frequency
—
1.53
MHz
tADC_S — D Sample time7
fADC = 20 MHz,
INPSAMP = 3
125
—
ns
fADC = 9 MHz,
INPSAMP = 255
—
28.2
s
tADC_C — P Conversion time8
fADC = 20 MHz9,
INPCMP = 1
0.650
—
s
tADC_PU SR — ADC power-up delay (time
needed for ADC to settle
exiting from software power
down; PWDN bit = 0)
——
—
1.5
s
CS10
— D ADC input sampling
capacitance
——
—
2.5
pF
CP110 — D ADC input pin capacitance 1
—
3
pF
CP210 — D ADC input pin capacitance 2
—
1
pF
VA
VA2
------------
CP1 CP2
+CF
+
CP1 CP2
+CF CS
++
--------------------------------------------------------
=
CF 2048 CS
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