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参数资料
| 型号： | SPC563M54L3COBR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, LEAD FREE, LQFP-100 |
| 文件页数： | 35/142页 |
| 文件大小： | 1334K |
| 代理商： | SPC563M54L3COBR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页当前第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页
Overview
SPC563Mxx
Doc ID 14642 Rev 4
–9-bit vector
Unique vector for each interrupt request source
Provided by hardware connection to processor or read from register
–
Each interrupt source can be programmed to one of 16 priorities
–Preemption
Preemptive prioritized interrupt requests to processor
ISR at a higher priority preempts ISRs or tasks at lower priorities
Automatic pushing or popping of preempted priority to or from a LIFO
Ability to modify the ISR or task priority. Modifying the priority can be used to
implement the Priority Ceiling Protocol for accessing shared resources.
–
Low latency—three clocks from receipt of interrupt request from peripheral to
interrupt request to processor
●
Frequency Modulating Phase-locked loop (FMPLL)
–
Reference clock Pre-Divider (PREDIV) for finer frequency synthesis resolution
–
Reduced Frequency Divider (RFD) for reducing the FMPLL output clock frequency
without forcing the FMPLL to re-lock
–
System clock Divider (SYSDIV) for reducing the system clock frequency in normal
or bypass mode
–
Input clock frequency range from 4 MHz to 20 MHz before the pre-divider, and
from 4 MHz to 16 MHz at the FMPLL input
–
Voltage Controlled Oscillator (VCO) range from 256 MHz to 512 MHz
–
VCO free-running frequency range from 25 MHz to 125 MHz
–
Four bypass modes: crystal or external reference with PLL on or off
–
Two normal modes: crystal or external reference
–
Programmable frequency modulation
Triangle wave modulation
Register programmable modulation frequency and depth
–
Lock detect circuitry reports when the FMPLL has achieved frequency lock and
continuously monitors lock status to report loss of lock conditions
User-selectable ability to generate an interrupt request upon loss of lock
User-selectable ability to generate a system reset upon loss of lock
–
Clock Quality Monitor (CQM) module provides loss-of-clock detection for the
FMPLL reference and output clocks
User-selectable ability to generate an interrupt request upon loss of clock
User-selectable ability to generate a system reset upon loss of clock
Backup clock (reference clock or FMPLL free-running) can be applied to the
system in case of loss of clock
●
Calibration bus interface (EBI)
–
Available only in the calibration package
–
1.8 V to 3.3 V ± 10 % I/O (1.6 V to 3.6 V)
–
Memory controller with support for various memory types
–
16-bit data bus, up to 22-bit address bus
–
Selectable drive strength
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