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参数资料
| 型号： | ST72345C4T6TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MICROCONTROLLER, PQFP48 |
| 封装： | 7 X 7 MM, ROHS COMPLIANT, TQFP-32 |
| 文件页数： | 116/246页 |
| 文件大小： | 2016K |
| 代理商： | ST72345C4T6TR |
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Electrical characteristics
ST72344xx, ST72345xx
202/246
The ST7 internal clock can be supplied by an internal RC oscillator and PLL (selectable by
option byte).
Table 88.
AVD thresholds
Symbol
Parameter
Conditions(1)
1.
TA = -40 to +85°C unless otherwise specified.
Min (2)
2.
Not tested in production, guaranteed by characterization.
Typ
Max (2)
Unit
VIT+(AVD)
1=>0 AVDF flag toggle threshold
(VDD rise)
High threshold
Med. threshold
Low threshold
4.15
3.64
3.00
4.50
3.96
3.28
4.91
4.30
3.54
V
VIT-(AVD)
0=>1 AVDF flag toggle threshold
(VDD fall)
High threshold
Med. threshold
Low threshold
3.96
3.44
2.85
4.28
3.76
3.11
4.66
4.06
3.35
Vhys(AVD) AVD voltage threshold hysteresis VIT+(AVD)-VIT-(AVD)
200
mV
ΔVIT-
Voltage drop between ADV flag
set and LVD reset activated
VIT-(AVD)-VIT-(LVD)
450
mV
Table 89.
PLL characteristics
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
fPLLIN
PLL Input frequency (1)
1.
Guaranteed by design.
VDD = 2.7 to 3.65 V
PLL option x4 selected
0.95
1
1.05
MHz
VDD = 3.3 to 5.5 V
PLL option x8 selected
0.90
1
1.10
VDD(PLL)
PLL operating range
PLL option x4 selected (2)
2.
To obtain a x4 multiplication ratio in the range 3.3 to 5.5V, the DIV2EN option bit must enabled.
2.7
3.65
V
PLL option x8 selected
3.3
5.5
tw(JIT)
PLL jitter period
fRC = 1 MHz
8
kHz
JITPLL
PLL jitter (
ΔfCPU/fCPU)
VDD = 3.0 V
3.0
%
VDD = 5.0 V
1.6
IDD(PLL)
PLL current
consumption
TA=25 °C
600
A
Table 90.
Internal RC oscillator and PLL
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VDD(RC)
Internal RC oscillator
operating voltage
Refer to operating range
of VDD with TA,
2.7
5.5
V
VDD(x4PLL) x4 PLL operating voltage
2.7
5.5
VDD(x8PLL) x8 PLL operating voltage
3.3
5.5
tSTARTUP
PLL Startup time
60
PLL input
clock (fPLL)
cycles
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参数描述 |
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