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参数资料
| 型号： | ST72623F2M1L |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PDSO34 |
| 封装： | PLASTIC, SO-34 |
| 文件页数： | 24/136页 |
| 文件大小： | 2475K |
| 代理商： | ST72623F2M1L |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页当前第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页
ST7262
12/136
Table 2. Hardware Register Map
Address
Block
Register
Label
Register Name
Reset
Status
Remarks
0000h
0001h
Port A
PADR
PADDR
Port A Data Register
Port A Data Direction Register
00h1)
00h
R/W2)
0002h
0003h
Port B
PBDR
PBDDR
Port B Data Register
Port B Data Direction Register
00h1)
00h
R/W2)
0004h
0005h
Port C
PCDR
PCDDR
Port C Data Register
Port C Data Direction Register
00h1)
00h
R/W2)
0006h
0007h
Port D
PDDR
PDDDR
Port D Data Register
Port D Data Direction Register
00h1)
00h
R/W2)
0008h
ITRFRE1
Interrupt Register 1
00h
R/W
0009h
MISC
Miscellaneous Register
00h
R/W
000Ah
000Bh
000Ch
ADC
ADCDRMSB
ADCDRLSB
ADCCSR
ADC Data Register (bit 9:2)
ADC Data Register (bit 1:0)
ADC Control Status Register
00h
Read Only
R/W
000Dh
WDG
WDGCR
Watchdog Control Register
7Fh
R/W
000Eh
0010h
Reserved Area (3 Bytes)
0011h
0012h
0013h
SPI
SPIDR
SPICR
SPICSR
SPI Data I/O Register
SPI Control Register
SPI Control Status Register
xxh
0xh
00h
R/W
Read Only
0014h
0015h
0016h
0017h
0018h
0019h
001Ah
001Bh
001Ch
PWM ART
PWMDCR1
PWMDCR0
PWMCR
ARTCSR
ARTCAR
ARTARR
ARTICCSR
ARTICR1
ARTICR2
PWM AR Timer Duty Cycle Register 1
PWM AR Timer Duty Cycle Register 0
PWM AR Timer Control Register
Auto-Reload Timer Control/Status Register
Auto-Reload Timer Counter Access Register
Auto-Reload Timer Auto-Reload Register
ART Input Capture Control/Status Register
ART Input Capture Register 1
ART Input Capture Register 2
00h
R/W
Read Only
001Dh
001Eh
001Fh
0020h
0021h
0022h
0023h
0024h
SCI
SCIERPR
SCIETPR
SCISR
SCIDR
SCIBRR
SCICR1
SCICR2
SCI Extended Receive Prescaler register
SCI Extended Transmit Prescaler Register
Reserved Area
SCI Status register
SCI Data register
SCI Baud Rate Register
SCI Control Register 1
SCI Control Register 2
00h
--
C0h
xxh
00h
x000 0000b
00h
R/W
Read Only
R/W
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