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参数资料
| 型号： | ST72F324BJ2TCRS |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, ROHS COMPLIANT, LQFP-44 |
| 文件页数： | 191/198页 |
| 文件大小： | 2025K |
| 代理商： | ST72F324BJ2TCRS |
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On-chip peripherals
ST72324B-Auto
92/198
Doc ID13466 Rev 4
Control/Status Register (CSR)
M
CSR
Reset value: xxxx x0xx (xxh)
76
543
21
0
ICF1
OCF1
TOF
ICF2
OCF2
TIMD
Reserved
RO
R/W
-
Table 51.
CSR register description
Bit
Name
Function
7ICF1
Input Capture Flag 1
0: No Input Capture (reset value).
1: An Input Capture has occurred on the ICAP1 pin or the counter has reached the
OC2R value in PWM mode. To clear this bit, first read the SR register, then read or
write the low byte of the IC1R (IC1LR) register.
6OCF1
Output Compare Flag 1
0: No match (reset value).
1: The content of the free running counter has matched the content of the OC1R
register. To clear this bit, first read the SR register, then read or write the low byte of
the OC1R (OC1LR) register.
5TOF
Timer Overflow Flag
0: No timer overflow (reset value).
1: The free running counter rolled over from FFFFh to 0000h. To clear this bit, first
read the SR register, then read or write the low byte of the CR (CLR) register.
Note: Reading or writing the ACLR register does not clear TOF.
4ICF2
Input Capture Flag 2
0: No input capture (reset value).
1: An Input Capture has occurred on the ICAP2 pin. To clear this bit, first read the SR
register, then read or write the low byte of the IC2R (IC2LR) register.
3OCF2
Output Compare Flag 2
0: No match (reset value).
1: The content of the free running counter has matched the content of the OC2R
register. To clear this bit, first read the SR register, then read or write the low byte of
the OC2R (OC2LR) register.
2TIMD
Timer Disable
This bit is set and cleared by software. When set, it freezes the timer prescaler and
counter and disabled the output functions (OCMP1 and OCMP2 pins) to reduce
power consumption. Access to the timer registers is still available, allowing the timer
configuration to be changed, or the counter reset, while it is disabled.
0: Timer enabled.
1: Timer prescaler, counter and outputs disabled.
1:0
-
Reserved, must be kept cleared.
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PDF描述 |
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