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参数资料
| 型号： | ST72F324BJ6TCRS |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, ROHS COMPLIANT, LQFP-44 |
| 文件页数： | 197/198页 |
| 文件大小： | 2025K |
| 代理商： | ST72F324BJ6TCRS |
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On-chip peripherals
ST72324B-Auto
98/198
Doc ID13466 Rev 4
Note:
In slave mode, continuous transmission is not possible at maximum frequency due to the
software overhead for clearing status flags and to initiate the next transmission sequence.
10.4.3
General description
Figure 49 shows the serial peripheral interface (SPI) block diagram. The SPI has three
registers:
●
SPI Control Register (SPICR)
●
SPI Control/Status Register (SPICSR)
●
SPI Data Register (SPIDR)
The SPI is connected to external devices through four pins:
●
MISO: Master In / Slave Out data
●
MOSI: Master Out / Slave In data
●
SCK: Serial Clock out by SPI masters and input by SPI slaves
●
SS: Slave select: This input signal acts as a ‘chip select’ to let the SPI master
communicate with slaves individually and to avoid contention on the data lines. Slave
SS inputs can be driven by standard I/O ports on the master MCU.
Figure 48.
Serial peripheral interface block diagram
Functional description
A basic example of interconnections between a single master and a single slave is
illustrated in Figure 49.
SPIDR
Read Buffer
8-bit Shift Register
Write
Read
Data/Address bus
SPI
SPIE
SPE
MSTR
CPHA
SPR0
SPR1
CPOL
Serial clock
generator
MOSI
MISO
SS
SCK
control
state
SPICR
SPICSR
Interrupt
request
Master
control
SPR2
0
7
0
7
SPIF WCOL
MODF
0
OVR
SSI
SSM
SOD
bit
SS
1
0
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