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参数资料
| 型号： | ST72F32AK1TARE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件页数： | 184/201页 |
| 文件大小： | 3595K |
| 代理商： | ST72F32AK1TARE |
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Obsolete
Product(s)
- Obsolete
Product(s)
ST7232Axx-Auto
On-chip peripherals
83/201
Input capture
In this section, the index, i, may be 1 or 2 because there are 2 input capture functions in the
16-bit timer.
The two 16-bit input capture registers (IC1R and IC2R) are used to latch the value of the
free running counter after a transition is detected on the ICAPi pin (see below).
ICiR register is a read-only register.
The active transition is software programmable through the IEDGi bit of Control Registers
(CRi).
Timing resolution is one count of the free running counter: (fCPU/CC[1:0]).
Procedure
To use the input capture function select the following in the CR2 register:
●
The timer clock (CC[1:0]) (see Table 36: CR2 register description)
●
The edge of the active transition on the ICAP2 pin with the IEDG2 bit (the ICAP2 pin
must be configured as floating input or input with pull-up without interrupt if this
configuration is available).
Select the following in the CR1 register:
●
Set the ICIE bit to generate an interrupt after an input capture coming from either the
ICAP1 pin or the ICAP2 pin.
●
Select the edge of the active transition on the ICAP1 pin with the IEDG1 bit (the
ICAP1pin must be configured as floating input or input with pull-up without interrupt if
this configuration is available).
When an input capture occurs:
●
ICFi bit is set
●
The ICiR register contains the value of the free running counter on the active transition
on the ICAPi pin (see Figure 38).
●
A timer interrupt is generated if the ICIE bit is set and the I bit is cleared in the CC
register. Otherwise, the interrupt remains pending until both conditions become true.
Clearing the input capture interrupt request (i.e. clearing the ICFi bit) is done in two steps:
1.
By reading the SR register while the ICFi bit is set
2.
By accessing (reading or writing) the ICiLR register
MSB
LSB
ICiR
ICiHR
ICiLR
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