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参数资料
| 型号： | ST72F340S2T6 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, LEAD FREE, LQFP-44 |
| 文件页数： | 40/191页 |
| 文件大小： | 3285K |
| 代理商： | ST72F340S2T6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页当前第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页
ST72340, ST72344, ST72345
134/191
I2C3S INTERFACE (Cont’d)
11.7.5.4 Rollover Handling
The RAM buffer of each slave is divided into pages
whose length is defined according to PL1:0 bits in
I2C3SCR1. Rollover takes place in these pages as
described below.
In the case of Page Write, if the number of data
bytes transmitted is more than the page length, the
current address will roll over to the first byte of the
current page and the previous data will be
overwritten. This page size is configured using
PL[1:0] bit in the I2C3SCR1 register.
In case of Sequential Read, if the current address
register value reaches the memory address limit
the address will roll over to the first address of the
reserved area for the respective slave.
There is no status flag to indicate the roll over.
Note:
The reserved areas for slaves 1 and 2 have a limit
of 256 bytes. The area for slave 3 is 128 bytes.
The MSB of the address is hardwired, the
addressing master therefore needs to send only
an 8 bit address.
The page boundaries are defined based on page
size
configuration
using
PL[1:0]
bit
in
the
I2C3SCR1 register. If an 8-byte page size is
selected, the upper 5 bits of the RAM address are
fixed and the lower 3 bits are incremented. For
example, if the page write starts at register
address 0x0C, the write will follow the sequence
0x0C, 0x0D, 0x0E, 0x0F, 0x08, 0x09, 0x0A, 0x0B.
If a 16-byte page size is selected, the upper 4 bits
of the RAM address are fixed and the lower 4 bits
are incremented. For example if the page write
starts at register address 0x0C, the write will follow
the sequence 0x0C, 0x0D, 0x0E, 0x0F, 0x00,
0x01, etc.
11.7.5.5 Error Conditions
– BERR: Detection of a Stop or a Start condition
during a byte transfer. In this case, the BERR bit
is set by hardware with an interrupt if ITER is set.
During a stop condition, the interface discards
the data, releases the lines and waits for another
Start condition. However, a BERR on a Start
condition will result in the interface discarding the
data and waiting for the next slave address on
the bus.
– NACK: Detection of a non-acknowledge bit not
followed by a Stop condition. In this case, NACK
bit is set by hardware with an interrupt if ITER is
set.
Figure 72. Transfer Sequencing
Legend: S=Start, P=Stop, A=Acknowledge, NA=Non-acknowledge,
WF = WF event, WFx bit is set (with interrupt if ITWEx=1, after Stop or Restart conditions), cleared by
reading the I2C3SSR register while no communication is ongoing.
RF = RF event, RFx is set (with interrupt if ITREx=1, after Stop or Restart conditions) , cleared by reading
the I2C3SSR register while no communication is ongoing.
BusyW = BusyW flag in the I2C3CR2 register set, cleared by software writing 0.
Note: The I2C3S supports a repeated start (Sr) in place of a stop condition (P).
7-bit Slave receiver:
7-bit Slave transmitter:
S Address
A
Data1
A
Data2
A
.....
DataN
A
P
WF
BusyW
S Address
A
Data1
A
Data2
A
.....
DataN
NA P
RF
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PDF描述 |
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