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参数资料
| 型号： | ST92163E |
| 厂商： | 意法半导体 |
| 英文描述： | 8/16-BIT FULL SPEED USB MCU FOR COMPOSITE DEVICES WITH 16 ENDPOINTS, 20K ROM, 2K RAM, I2C, SCI, & MFT |
| 中文描述： | 16位产品全速USB微控制器16端点，20,000光盘和2K的RAM，I2C和脊髓损伤的复合设备， |
| 文件页数： | 150/224页 |
| 文件大小： | 1372K |
| 代理商： | ST92163E |
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ST92163 - SERIAL COMMUNICATIONS INTERFACE (SCI)
8.4 SERIAL COMMUNICATIONS INTERFACE (SCI)
8.4.1 Introduction
The Serial Communications Interface (SCI) offers
full-duplex serial data exchange with a wide range
of external equipment. The SCI offers four operat-
ing modes: Asynchronous, Asynchronous with
synchronous clock, Serial expansion and Syn-
chronous.
The SCI offers the following principal features:
I
Full duplex synchronous and asynchronous
operation.
I
Transmit, receive, line status, and device
address interrupt generation.
I
Integral Baud Rate Generator capable of
dividing the input clock by any value from 2 to
2
16
-1 (16 bit word) and generating the internal
16X data sampling clock for asynchronous
operation or the 1X clock for synchronous
operation.
I
Fully programmable serial interface:
– 5, 6, 7, or 8 bit word length.
– Even, odd, or no parity generation and detec-
tion.
– 0, 1, 1.5, 2, 2.5, 3 stop bit generation.
– Complete status reporting capabilities.
– Line break generation and detection.
I
Programmable address indication bit (wake-up
bit) and user invisible compare logic to support
multiple microcomputer networking. Optional
character search function.
I
Internal diagnostic capabilities:
– Local loopback for communications link fault
isolation.
– Auto-echo for communications link fault isola-
tion.
I
Separate interrupt/DMA channels for transmit
and receive.
I
In addition, a Synchronous mode supports:
– High speed communication
– Possibility of hardware synchronization (RTS/
DCD signals).
– Programmable polarity and stand-by level for
data SIN/SOUT.
– Programmable activeedge and stand-by level
for clocks CLKOUT/RXCL.
– Programmable active levels of RTS/DCD sig-
nals.
– Full Loop-Back and Auto-Echo modes for DA-
TA, CLOCKs and CONTROLs.
Figure 71. SCI Block Diagram
TRANSMIT
BUFFER
REGISTER
REGISTER
TSHIFT
REGISTER
SHIFT
RECEIVER
FUNCTION
ALTERNATE
REGISTER
COMPARE
ADDRESS
REGISTER
BUFFER
RECEIVER
DMA
CONTROLLER
CLOCK and
BAUDRATE
GENERATOR
ST9 CORE BUS
SOUT
TXCLK/CLKOUT RXCLK
SIN
VA00169A
Frame Control
and STATUS
DMA
CONTROLLER
RTS
DCD
SDS
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PDF描述 |
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