- 您现在的位置：买卖IC网 > PDF目录380730 > ST92163L (意法半导体) 8/16-BIT FULL SPEED USB MCU FOR COMPOSITE DEVICES WITH 16 ENDPOINTS, 20K ROM, 2K RAM, I2C, SCI, & MFT PDF资料下载
参数资料
| 型号： | ST92163L |
| 厂商： | 意法半导体 |
| 英文描述： | 8/16-BIT FULL SPEED USB MCU FOR COMPOSITE DEVICES WITH 16 ENDPOINTS, 20K ROM, 2K RAM, I2C, SCI, & MFT |
| 中文描述： | 16位产品全速USB微控制器16端点，20,000光盘和2K的RAM，I2C和脊髓损伤的复合设备， |
| 文件页数： | 212/224页 |
| 文件大小： | 1372K |
| 代理商： | ST92163L |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页当前第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页
212/224
ST92163 - ELECTRICAL CHARACTERISTICS
EXTERNAL BUS TIMING TABLE
(V
DD
= 3.0 - 5.5V
(1)
, T
A
= 0
°
C + 70
°
C, C
Load
= 50pF, f
INTCLK
= 24MHz, unless otherwise specified)
Note:
The value in the lefthand column shows the formula used tocalculate the timing minimum ormaximum from the oscillator clock period,
prescaler value and number of wait cycles inserted.
The values in the right hand two columns show the timing minimum and maximum for an external clock at 24MHz, prescaler value of zero
and zero wait states.
(1) 3.0 - 4.0V voltage range is only available on devices with suffix L or V, with different frequency limitations(L: 8 MHz, V: 16 MHz)
Legend
:
Tck = INTCLK period = OSCIN period when OSCIN is not divided by 2;
2 x OSCIN period when OSCIN is divided by 2;
OSCIN period x PLL factor when the PLL is enabled.
TckH = INTCLK high pulse width (normally = Tck/2, except when INTCLK = OSCIN, in which case it is OSCIN high pulse width)
TckL = INTCLK low pulse width (normally = Tck/2, except when INTCLK = OSCIN, in which case it is OSCIN low pulse width)
P = clock prescaling value (=PRS; division factor = 1+P)
Wa = wait cycles on AS; =max (P, programmed wait cycles in EMR2, requested wait cycles with WAIT)
Wd = wait cycles on DS; = max (P, programmed wait cycles in WCR, requested wait cycles with WAIT)
N
°
Symbol
Parameter
Value (Note)
Formula
Unit
Min
12
17
Max
1
2
3
4
5
6
7
8
9
TsA (AS)
ThAS (A)
TdAS (DR)
TwAS
TdAz (DS)
TwDS
TdDSR (DR)
ThDR (DS)
TdDS (A)
TdDS (AS)
TsR/W (AS)
TdDSR (R/W)
TdDW (DSW)
TsD(DSW)
ThDS (DW)
TdA (DR)
TdAs (DS)
Address Set-up Time before AS
↑
Address Hold Time after AS
↑
AS
↑
to Data Available (read)
AS Low Pulse Width
Address Float to DS
↓
DS Low Pulse Width
DS
↓
to Data Valid Delay (read)
Data to DS
↑
Hold Time (read)
DS
↑
to Address Active Delay
DS
↑
to AS
↓
Delay
RW Set-up Time before ASN
↑
DS
↑
to RW and Address Not Valid Delay
Write Data Valid to DS
↓
Delay
Write Data Set-up before DS
↑
Data Hold Time after DS
↑
(write)
Address Valid to Data Valid Delay (read)
AS
↑
to DS
↓
Delay
Tck x Wa+TckH-9
TckL-4
Tck x (Wd+1)+3
Tck x Wa+TckH-5
0
Tck x Wd+TckH-5
Tck x Wd+TckH+4
7
TckL+11
TckL-4
Tck x Wa+TckH-17
TckL-1
-16
Tck x Wd+TckH-16
TckL-3
Tck x (Wa+Wd+1)+TckH-7
TckL-6
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
45
16
0
16
25
7
32
17
4
20
-16
5
18
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11
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15
16
17
55
15
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PDF描述 |
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