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参数资料
| 型号： | ST92163N4D0L |
| 厂商： | 意法半导体 |
| 英文描述： | 8/16-BIT FULL SPEED USB MCU FOR COMPOSITE DEVICES WITH 16 ENDPOINTS, 20K ROM, 2K RAM, I2C, SCI, & MFT |
| 中文描述： | 16位产品全速USB微控制器16端点，20,000光盘和2K的RAM，I2C和脊髓损伤的复合设备， |
| 文件页数： | 83/224页 |
| 文件大小： | 1372K |
| 代理商： | ST92163N4D0L |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页当前第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页
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ST92163 - RESET AND CLOCK CONTROL UNIT (RCCU)
PLL CONFIGURATION REGISTER (PLLCONF)
R246 - Read/Write
Register Page: 55
Reset Value: xx00 x111
7
Bit 7:6 = Reserved.
Bit 5:4 =
MX[1:0]
: PLL Multiplication Factor
Refer to Table 14 for multiplier settings.
Bit 3 = Reserved.
Bit 2:0 =
DX[2:0]
: PLL output clock divider factor.
Refer to Table 15 for divider settings.
Table 14. PLL Multiplication Factors
Table 15. Divider Configuration
Figure 39. RCCU General Timing
0
-
-
MX1
MX0
-
DX2
DX1
DX0
MX1
1
0
1
0
MX0
0
0
1
1
CLOCK2 x
14
10
8
6
DX2
0
0
0
0
1
1
1
DX1
0
0
1
1
0
0
1
DX0
0
1
0
1
0
1
0
CK
PLL CLOCK/1
PLL CLOCK/2
PLL CLOCK/3
PLL CLOCK/4
PLL CLOCK/5
PLL CLOCK/6
PLL CLOCK/7
CLOCK2
(PLL OFF, Reset State)
1
1
1
STOP
Acknowledged
STOP
pin
External
Multiplier
clock
Xtal
clock
INTCLK
Internal
reset
PLL selected by user
((N-1)*512+510)xT
Xtal
(**)
PLL
Lock-in
time
PLL
Lock-in
time
4 xT
sys
Quartz
start-up
Exit from RESET
510 x T
Xtal
(*)
(*) if DIV2 =1
Switch to
PLL clock
(**) +/- 1 T
Xtal
PLL turned on by user
Xtal/2
PLL
PLL
Xtal/2
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PDF描述 |
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