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参数资料
| 型号： | ST92F150JCV1TC |
| 厂商： | 意法半导体 |
| 英文描述： | Zener Diode 225 mW 91 V ±5% SOT-23; Package: SOT-23 (TO-236) 3 LEAD; No of Pins: 3; Container: Tape and Reel; Qty per Container: 3000 |
| 中文描述： | 16位产品单电压闪存MCU的家庭的RAM，EEPROM的E3展TMEMULATED，可以2.0b和J1850 BLPD |
| 文件页数： | 140/426页 |
| 文件大小： | 3831K |
| 代理商： | ST92F150JCV1TC |
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140/426
ST92F124/F150/F250 - RESET AND CLOCK CONTROL UNIT (RCCU)
RESET/STOP MANAGER
(Cont’d)
The on-chip Timer/Watchdog generates a reset
condition if the Watchdog mode is enabled
(WCR.WDGEN cleared, R252 page 0), and if the
programmed period elapses without the specific
code (AAh, 55h) written to the appropriate register.
The input pin RESET is not driven low by the on-
chip reset generated by the Timer/Watchdog.
When the Reset pin goes high again, 20479 oscil-
lator clock cycles (CLOCK1) are counted before ex-
iting the Reset state (
+
one possible
CLOCK1 pe-
riod, depending on the delay between the rising
edge of the Reset pin and the first rising edge of
CLOCK1). Subsequently a short Boot routine is ex-
ecuted from the device internal Boot memory, and
control then passes to the user program.
The Boot routine sets the device characteristics
and loads the correct values in the Memory Man-
agement Unit’s pointer registers, so that these
point to the physical memory areas as mapped in
the specific device. The precise duration of this
short Boot routine varies from device to device,
depending on the Boot memory contents.
At the end of the Boot routine the Program Coun-
ter will be set to the location specified in the Reset
Vector located in the lowest two bytes of memory.
7.6.1 Reset Pin Timing
To improve the noise immunity of the device, the
Reset pin has a Schmitt trigger input circuit with
hysteresis. In addition, a filter will prevent an un-
wanted reset in case of a single glitch of less than
50 ns on the Reset pin. The device is certain to re-
set if a negative pulse of more than 20
μ
s is ap-
plied. When the reset pin goes high again, a delay
of up to 4
μ
s will elapse before the RCCU detects
this rising front. From this event on, a defined
number of CLOCK1 cycles (refer to t
) is
counted before exiting the Reset state (
+
one pos-
sible CLOCK1 period depending on the delay be-
tween the positive edge the RCCU detects and the
first rising edge of CLOCK1).
If the ST9 is a ROMLESS version, without on-chip
program memory, the memory interface ports are
set to external memory mode (i.e Alternate Func-
tion) and the memory accesses are made to exter-
nal Program memory with wait cycles insertion.
If the Voltage Regulator is present in the device,
please ensure the reset pin is released only when
the internal voltage supply is stabilized at 3.3V.
Figure 71. Recommended Signal to be Applied
on Reset Pin
Figure 72. Reset Pin Input Structure
V
RESETN
V
DD
V
IHRS
V
ILRS
20
μ
s
Minimum
PIN
E
SD PROTECTION
CIRCUITRY
SCHMITT TRIGGER and LOW
PASS FILTER
TO GENERATE RESET SIGNAL
9
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