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参数资料
| 型号： | STM8AF52A9TDX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, ROHS COMPLIANT, LQFP-64 |
| 文件页数： | 107/120页 |
| 文件大小： | 2236K |
| 代理商： | STM8AF52A9TDX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页当前第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页
STM8AF52/62xx, STM8AF51/61xx
Electrical characteristics
Doc ID 14395 Rev 7
10.3.9
SPI interface
Unless otherwise specified, the parameters given in Table 57 are derived from tests
performed under ambient temperature, fMASTER frequency, and VDD supply voltage
conditions. tMASTER = 1/fMASTER.
Refer to I/O port characteristics for more details on the input/output alternate function
characteristics (NSS, SCK, MOSI, MISO).
Table 57.
SPI characteristics
Symbol
Parameter
Conditions
Min
Max
Unit
fSCK
1/tc(SCK)
SPI clock frequency
Master mode
0
10
MHz
Slave mode
VDD < 4.5 V
0
6(1)
VDD = 4.5 V to 5.5 V
0
8(1)
tr(SCK)
tf(SCK)
SPI clock rise and fall time Capacitive load: C = 30 pF
—
25(2)
ns
tsu(NSS)
(3)
NSS setup time
Slave mode
4 * tMASTER
—
th(NSS)
NSS hold time
Slave mode
70
—
tw(SCKH)
tw(SCKL)
SCK high and low time
Master mode,
fMASTER = 8 MHz, fSCK= 4 MHz
110
140
tsu(MI)
tsu(SI)
Data input setup time
Master mode
5
—
Slave mode
5
—
th(MI)
th(SI)
Data input hold time
Master mode
7
—
Slave mode
10
—
ta(SO)
Data output access time
Slave mode
—
3* tMASTER
tdis(SO)
(3)(5) Data output disable time
Slave mode
25
tv(SO)
Data output valid time
Slave mode
(after enable edge)
VDD < 4.5 V
—
75
VDD = 4.5 V to 5.5 V
—
53
tv(MO)
Data output valid time
Master mode (after enable edge)
—
30
th(SO)
Data output hold time
Slave mode (after enable edge)
31
—
Master mode (after enable edge)
12
—
1.
fMAX is fMASTER/2.
2.
The pad has to be configured accordingly (fast mode).
3.
Values based on design simulation and/or characterization results, and not tested in production.
4.
Min time is for the minimum time to drive the output and the max time is for the maximum time to validate the data.
5.
Min time is for the minimum time to invalidate the output and the max time is for the maximum time to put the data in Hi-Z.
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PDF描述 |
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