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参数资料
| 型号： | STM8AF6146TBY |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件页数： | 41/99页 |
| 文件大小： | 881K |
| 代理商： | STM8AF6146TBY |
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Interrupt table
STM8AF61xx, STM8AF62xx
Doc ID 14952 Rev 4
8
Interrupt table
Table 30.
STM8A interrupt table
Priority
Source
block
Description
Interrupt vector
address
Wakeup
from halt
Comments
—
Reset
6000h
Yes
Reset vector in ROM
—
TRAP
SW interrupt
8004h
—
0
TLI
External top level interrupt
8008h
—
1
AWU
Auto-wakeup from halt
800Ch
Yes
—
2
Clock
controller
Main clock controller
8010h
—
3
MISC
Ext interrupt E0
8014h
Yes
Port A interrupts
4
MISC
Ext interrupt E1
8018h
Yes
Port B interrupts
5
MISC
Ext interrupt E2
801Ch
Yes
Port C interrupts
6
MISC
Ext interrupt E3
8020h
Yes
Port D interrupts
7
MISC
Ext interrupt E4
8024h
Yes
Port E interrupts
8
Reserved(1)
1.
All reserved and unused interrupts must be initialized with ‘IRET’ for robust programming.
——
—
9
Reserved(1)
——
—
10
SPI
End of transfer
8030h
Yes
—
11
Timer 1
Update/overflow/
trigger/break
8034h
—
12
Timer 1
Capture/compare
8038h
—
13
Timer 2
Update/overflow
803Ch
—
14
Timer 2
Capture/compare
8040h
—
15
Timer 3
Update/overflow
8044h
—
16
Timer 3
Capture/compare
8048h
—
17
Reserved(1)
——
—
18
Reserved(1)
——
—
19
I2C
I2C interrupts
8054h
Yes
—
20
LINUART
(SCI2)
Tx complete/error
8058h
—
21
LINUART
(SCI2)
Receive data full reg.
805Ch
—
22
ADC
End of conversion
8060h
—
23
Timer 4
Update/overflow
8064h
—
24
EEPROM
End of Programming/
Write in not allowed area
8068h
—
相关PDF资料 |
PDF描述 |
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