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参数资料
| 型号： | STM8L101K3T3TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, RISC MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, ROHS COMPLIANT, LQFP-32 |
| 文件页数： | 21/81页 |
| 文件大小： | 1995K |
| 代理商： | STM8L101K3T3TR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页当前第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页
Memory and register map
STM8L101xx
Doc ID 15275 Rev 11
0x00 5250
TIM2
TIM2_CR1
TIM2 control register 1
0x00
0x00 5251
TIM2_CR2
TIM2 control register 2
0x00
0x00 5252
TIM2_SMCR
TIM2 slave mode control register
0x00
0x00 5253
TIM2_ETR
TIM2 external trigger register
0x00
0x00 5254
TIM2_IER
TIM2 interrupt enable register
0x00
0x00 5255
TIM2_SR1
TIM2 status register 1
0x00
0x00 5256
TIM2_SR2
TIM2 status register 2
0x00
0x00 5257
TIM2_EGR
TIM2 event generation register
0x00
0x00 5258
TIM2_CCMR1
TIM2 capture/compare mode register 1
0x00
0x00 5259
TIM2_CCMR2
TIM2 capture/compare mode register 2
0x00
0x00 525A
TIM2_CCER1
TIM2 capture/compare enable register 1
0x00
0x00 525B
TIM2_CNTRH
TIM2 counter high
0x00
0x00 525C
TIM2_CNTRL
TIM2 counter low
0x00
0x00 525D
TIM2_PSCR
TIM2 prescaler register
0x00
0x00 525E
TIM2_ARRH
TIM2 auto-reload register high
0xFF
0x00 525F
TIM2_ARRL
TIM2 auto-reload register low
0xFF
0x00 5260
TIM2_CCR1H
TIM2 capture/compare register 1 high
0x00
0x00 5261
TIM2_CCR1L
TIM2 capture/compare register 1 low
0x00
0x00 5262
TIM2_CCR2H
TIM2 capture/compare register 2 high
0x00
0x00 5263
TIM2_CCR2L
TIM2 capture/compare register 2 low
0x00
0x00 5264
TIM2_BKR
TIM2 break register
0x00
0x00 5265
TIM2_OISR
TIM2 output idle state register
0x00
0x00 5266
to
0x00 527F
Reserved area (26 bytes)
Table 7.
General hardware register map (continued)
Address
Block
Register label
Register name
Reset
status
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PDF描述 |
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