SN74LS373DWR
特性
选择8个门闩或8 D-TypeFlip-Flops在一个包中
3-State Bus-Driving OutputsD
全部为LoadingD并行访问
缓冲控制输入
Clock-Enable输入滞后改善噪音抑制(“S373和“S374)
pnp型输入减少直流负载DataLines(“S373和“S374)
SN74LS373DWR
描述
这些专门为8位寄存器功能3-state输出驱动高电容式或相对低阻抗的负载。
高阻抗3-state和增加高电平驱动提供这些寄存器的功能是直接连接和推动公交线路bus-organized系统不需要接口或引体向上组件。
这些设备实现缓冲寄存器,尤其具有吸引力的I / O端口,双向总线驱动程序和登记工作。
“LS373和“S373的八个门闩是透明型门闩,这意味着虽然使(C或CLK)输入高,Q输出数据(D)的输入。
当C或CLK低,输出是锁定在成立的数据。
八人字拖的“LS374和“S374边沿触发型人字拖。
在时钟的积极转变,Q输出设置为逻辑状态设置的D输入。
施米特触发器缓冲输入启用/时钟线的“S373和“S374设备简化系统设计提高交流和直流干扰抑制的通常是400 mV由于输入滞后。
输入缓冲输出控制(OC)可以被用来把八个输出正常的逻辑状态(高或低逻辑水平)或高阻抗状态。
在高阻抗状态,输出负载和显著推动公交线路。
OC并不影响的内部操作门闩或拖鞋。
即旧数据可以被保留或可以输入新数据,即使输出。
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