参数资料
型号: SY100E451JC
厂商: Micrel Inc
文件页数: 1/4页
文件大小: 0K
描述: IC DATA CLOCK 6BIT DIFF 28-PLCC
标准包装: 38
系列: 100E
功能: 主复位
类型: D 型总线
输出类型: 非反相
元件数: 1
每个元件的位元数: 6
频率 - 时钟: 1.4GHz
延迟时间 - 传输: 650ps
触发器类型: 正边沿
电源电压: 4.2 V ~ 5.7 V
工作温度: 0°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 28-LCC(J 形引线)
包装: 散装
1
SY10E451
SY100E451
Micrel, Inc.
M9999-032206
hbwhelp@micrel.com or (408) 955-1690
6-BIT REGISTER
DIFFERENTIAL DATA CLOCK
DESCRIPTION
The SY10/100E451 offer six D-type flip-flops with single-
ended outputs and differential data and clock inputs,
designed for use in new, high-performance ECL systems.
The registers are triggered by the rising edge of the CLK
input.
A logic HIGH on the Master Reset (MR) input resets all
outputs to a logic LOW. The VBB output is provided for use
as a reference voltage for single-ended reception of ECL
signals to that device only. When used for this purpose, it
is recommended that VBB is decoupled to VCC via a 0.01F
capacitor.
FEATURES
s 1100MHz min. toggle frequency
s Extended 100E V
EE range of –4.2V to –5.5V
s Differential inputs: data and clock
s V
BB output for single-ended use
s Asynchronous Master Reset
s Fully compatible with industry standard 10KH,
100K ECL levels
s Internal 75K
input pulldown resistors
s Fully compatible with Motorola MC10E/100E451
s Available in 28-pin PLCC package
SY10E451
SY100E451
BLOCK DIAGRAM
D
R
D
R
D
R
D
R
D
R
D
R
Q0
Q1
Q2
Q3
Q4
Q5
MR
D0
D1
D2
D3
D4
D5
VBB
CLK
/D0
/CLK
/D1
/D2
/D3
/D4
/D5
Pin
Function
D0–D5
+ Data Input
/D0–/D5
– Data Input
CLK
+ Clock Input
/CLK
– Clock Input
Q0–Q5
Data Outputs
MR
Master Reset Input
VBB
VBB Output
VCCO
VCC to Output
PIN NAMES
Rev.: G
Amendment: /0
Issue Date:
March 2006
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PDF描述
SY100E431JC TR IC FLIP FLOP 3-BIT DIFF 28-PLCC
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参数描述
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SY100E451JCTR 制造商:MICREL 制造商全称:Micrel Semiconductor 功能描述:6-BIT REGISTER DIFFERENTIAL DATA CLOCK
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