参数资料
| 型号： | SY10E175JC |
| 厂商： | Micrel Inc |
| 文件页数： | 1/4页 |
| 文件大小： | 0K |
| 描述： | IC LATCH 9-BIT W/PARITY 28-PLCC |
| 标准包装： | 38 |
| 系列： | 10E |
| 逻辑类型： | D 型透明锁存器 |
| 电路： | 9:9 |
| 输出类型： | 标准 |
| 电源电压： | 4.2 V ~ 5.5 V |
| 独立电路： | 1 |
| 延迟时间 - 传输： | 600ps |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-LCC（J 形引线） |
| 供应商设备封装： | 28-PLCC |
| 包装： | 管件 |
1
SY10E175
SY100E175
Micrel, Inc.
M9999-032006
hbwhelp@micrel.com or (408) 955-1690
Pin
Function
D0 – D8
Data Inputs
LEN
Latch Enable
MR
Master Reset
Q0 – Q8
Data Outputs
ODDPAR
Parity Output
VCCO
VCC to Output
DESCRIPTION
FEATURES
s 9-bit latch
s Extended 100E VEE range of –4.2V to –5.5V
s Parity detection/generation
s 800ps max. D to Output
s Reset
s Internal 75K
input pull-down resistors
s Fully compatible with Motorola MC10E/100E175
s Available in 28-pin PLCC package
The SY10/100E175 are 9-bit latches. They also feature
a tenth latched output (ODDPAR) which is formed as the
odd parity of the nine data inputs (ODDPAR is HIGH if
an odd number of the inputs are HIGH).
The E175 can also be used to generate byte parity by
using D8 as the parity-type select (L = even parity, H =
odd parity) and using ODDPAR as the byte parity output.
The LEN pin latches the data when asserted with a
logical high and makes the latch transparent when placed
at a logic low level.
9-BIT LATCH
WITH PARITY
SY10E175
SY100E175
BLOCK DIAGRAM
ODDPAR
D0
LEN
MR
Q8
Q0
D8
bits
1 – 7
D
EN
Q
R
D
EN
Q
R
D
EN
Q
R
PIN NAMES
Rev.: F
Amendment: /0
Issue Date:
March 2006
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PDF描述 |
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| SY10E193JC | 功能描述:IC PARITY GENERATOR 8BIT 28PLCC RoHS:否 类别:集成电路 (IC) >> 逻辑 - 奇偶校验发生器和校验器 系列:10E 产品变化通告:Product Obsolescence 30/Sept/2009 标准包装:25 系列:10H 逻辑类型:奇偶校验发生器/校验器 电路数:12 位 输出电流高，低:- 电源电压:4.94 V ~ 5.46 V 工作温度:0°C ~ 75°C 安装类型:通孔 封装/外壳:16-DIP（0.300"，7.62mm） 供应商设备封装:16-DIP |
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