参数资料
| 型号： | SY89874UMG |
| 厂商： | Micrel Inc |
| 文件页数： | 4/11页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFF DIVIDER 1:2 16-MLF |
| 标准包装： | 100 |
| 系列： | Precision Edge® |
| 类型： | 扇出缓冲器（分配），除法器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | CML，HSTL，LVDS，LVPECL |
| 输出： | LVPECL |
| 频率 - 最大： | 2.5GHz |
| 电源电压： | 2.375 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-VFQFN 裸露焊盘，16-MLF? |
| 供应商设备封装： | 16-MLF?（3x3） |
| 包装： | 管件 |
| 产品目录页面： | 1084 (CN2011-ZH PDF) |
| 其它名称： | 576-1437 |
Micrel, Inc.
SY89874U
October 1, 2013
2
Revision 1.1
hbwhelp@micrel.com or (408) 955-1690
Ordering Information
Part Number(1)
Package Type
Operating Range
Package Marking
Lead Finish
SY89874UMG
QFN-16
Industrial
874U with Pb-free
bar-line indicator
NiPdAu
SY89874UMGTR(2)
QFN-16
Industrial
874U with Pb-free
bar-line indicator
NiPdAu
Note:
1. Contact factory for die availability. Dice are guaranteed at TA = 25°C, DC electricals only.
2. Tape and Reel.
Pin Configuration
16-Pin QFN
Pin Description
Pin Number
Pin Name
Pin Function
12, 9
IN, /IN
Differential input. Internal 50 termination resistors to VT input. Flexible input accepts any
differential input. See the Input Interface Applications section.
1, 2, 3, 4
Q0, /Q0
Q1, /Q1
Differential buffered LVPECL Outputs. Divided by 1, 2, 4, 8, or 16. See Truth Table. Unused
PECL outputs may be left floating with no impact on jitter performance.
16, 15, 5
S0, S1, S2
Select pins. See Truth Table. LVTTL/CMOS logic levels. Internal 25k pull-up resistor. Logic
HIGH if left unconnected (divided by 16 mode). Input threshold is VCC/2.
6
NC
No connect.
8
/RESET
/DISABLE
LVTTL/CMOS logic levels. Internal 25k pull-up resistor. Logic HIGH if left unconnected. Apply
LOW to reset the divider (divided by 2, 4, 8, or 16 mode). Also acts as a synchronous
disable/enable function. The reset and disable function occurs on the next HIGH-to-LOW clock
input transition. Input threshold is VCC/2.
10
VREF-AC
Reference voltage. Equal to VCC-1.4V (approximately). Used for AC-coupled applications only.
Decouple the VREF-AC pin with a 0.01F capacitor. See the Input Interface Applications section.
11
VT
Termination center tap. For CML or LVDS inputs, leave this floating. Otherwise, see Figures 2a to
2f within the Input Interface Applications section.
7, 14
VCC
Positive power supply. Bypass with .01F /0.01F low-ESR capacitor.
13
GND
Ground.
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PDF描述 |
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参数描述 |
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