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参数资料
| 型号： | T436416A-7.5SG |
| 厂商： | TM Technology, Inc. |
| 英文描述： | 4M X 16 SDRAM |
| 中文描述： | 4米× 16内存 |
| 文件页数： | 21/29页 |
| 文件大小： | 712K |
| 代理商： | T436416A-7.5SG |
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TE
CH
tm
Read & Write Cycle with Auto Precharge @ Burst Length = 4
0
1
2
3
4
5
T436416A
TM Technology Inc. reserves the right
P.21
to change products or specifications without notice.
Publication Date: MAY. 2003
Revision: B
C L O C K
C K E
C S
R A S
C A S
A D D R
B A
A 1 0 /A P
C L = 2
C L = 3
W E
6
7
8
9
1 0
1 1
1 2
1 3
1 4
1 5
1 6
1 7
1 8
1 9
H IG H
D Q M
D Q
:D o n 't c a re
R o w A c tiv e
(A -B a n k )
R o w A c tiv e
(B -B a n k )
R e a d w ith A u to
p re c h a rg e (A -
B a n k )
C L = 2 A u to
P re c h a rg e S ta rt
P o in t (A -B a n k )
C L = 3 A u to
P re c h a rg e S ta rt
P o in t (A -B a n k )
W rite w ith A u to
P re c h a rg e (B -
B a n k )
A u to P re c h a rg e
S ta rt P o in t (A -
B a n k )
R a
R b
C a
C b
R a
R b
Q a 0
Q a 1
Q a 2
Q a 3
Q a 0
Q a 1
Q a 2
Q a 3
D b 0
D b 0
D b 1
D b 1
D b 2
D b 2
D b 3
D b 3
*Note : 1.
t
CDL
should be controlled to meet minimum
t
RAS
before internal precharge start.
(In the case of Burst Length = 1 & 2 and BRSW mode)
相关PDF资料 |
PDF描述 |
|---|---|
| T436416A-7S | TERMINAL BLOCK END BARRIER IEC +OPTIONS |
| T436416A-7SG | 4M X 16 SDRAM |
| T436416A-8S | 4M X 16 SDRAM |
| T436416A-8SG | 4M X 16 SDRAM |
| T436416C | 4M x 16 SDRAM 1M x 16bit x 4Banks Synchronous DRAM |
相关代理商/技术参数 |
参数描述 |
|---|---|
| T436416A-7S | 制造商:TMT 制造商全称:TMT 功能描述:4M X 16 SDRAM |
| T436416A-7SG | 制造商:TMT 制造商全称:TMT 功能描述:4M X 16 SDRAM |
| T436416A-8S | 制造商:TMT 制造商全称:TMT 功能描述:4M X 16 SDRAM |
| T436416A-8SG | 制造商:TMT 制造商全称:TMT 功能描述:4M X 16 SDRAM |
| T436416C | 制造商:TMT 制造商全称:TMT 功能描述:4M x 16 SDRAM 1M x 16bit x 4Banks Synchronous DRAM |
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