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参数资料
| 型号： | TDA5231 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PDSO28 |
| 封装： | GREEN, PLASTIC, TSSOP-28 |
| 文件页数： | 29/186页 |
| 文件大小： | 3820K |
| 代理商： | TDA5231 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页当前第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页
TDA523x
Functional Description
Data Sheet
120
Version 4.0, 2007-06-01
2.4.17
Interrupt Generation Unit
The Interrupt Generation Unit receives all possible interrupts and sets the NINT signal
based on the configuration of the Interrupt Mask register (IM). The Interrupt Status
register is set from the Interrupt Generation Unit, depending on which interrupt occurred.
The polarity of the interrupt that is routed to the NINT/NSTR Pin is defined in the CMC1
register. Please note that during power up and brown out reset, the polarity of the
NINT/NSTR Pin is always as described in Chapter 2.4.2 Chip Reset.
A Reset Event has the highest priority. It sets all bits in the Status register to “1” and sets
the Interrupt Pin to “0”. The first interrupt after the Reset Event will clear the Status
register and will set the Interrupt Pin to “1”, even if this interrupt is masked.
A wake up interrupt clears the FsyncA, FsyncB and the complementary wake up Flag. A
Fsync Interrupt clears the EOMA, EOMB, MIDA, MIDB and the complementary Fsync
Flag.
The Interrupt Status register is always cleared after it is read via SPI.
It is not possible to disable the Power On Reset Indicator Interrupt using the Interrupt
Mask register.
Figure 64
Interrupt Generation Unit
IS
Interrupt-Mask
Interrupt-Signalling
IM
Data Clock
Wa
k
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C
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A
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yn
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MI
D
A
PIN Function
from Digital
Receiver
NINT
NINT/NSTR Pin
NINTNSTRSEL
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