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参数资料
| 型号： | TH74KA22BVWJRNGD/T |
| 厂商： | ATMEL CORP |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, CQCC84 |
| 封装： | WINDOWED, CERAMIC, J LEAD PACKAGE-84 |
| 文件页数： | 2/20页 |
| 文件大小： | 1116K |
| 代理商： | TH74KA22BVWJRNGD/T |
TABLE 6 - TIMING AND SWITCHING CHARACTERISTICS
Parameter
Symbol
Value
Unit
Note
Min.
Typ.
Max.
INTEGRATION TIME
TI
0.05
3
ms
CLOCK PERIOD
Tck
0.33
2
s
(3)
READ ENABLE
Duration
TRE
149.5Tck+t1RE+t2RE
s
Rise time or fall time
tr/tf
25
250
ns
(4)
Delay
t1RE
0
120
ns
Set-up RE
t2RE
150
850
ns
LATERAL TRANSFER
Duration
T
Φx
522
s
Φx rise time or fall time
tr/tf
25
150
ns
(4)
Φ1 low level hold time
Tx1
1
1.7
s
Φ2 low level hold time
Tx2
4
20
s
Delay
t
Φx
100
980
ns
Readout delay
t
Φ1
100
200
ns
LONGITUDINAL TRANSFER
ΦL1 rise time or fall time
tr/tf
25
150
ns
(4)
ΦL2 rise time or fall time
tr/tf
25
150
ns
(4)
Preload duration
T
ΦPL
35
240
ns
Preload rise time or fall time
tr/tf
25
50
ns
(4)
Preload delay
tPL
0
80
ns
Skimming time
tsk
70
500
ns
(1)
READOUT DIODE RESET
Duration
T
ΦR
35
240
ns
(2)
Rise time or fall time
tr/tf
25
120
ns
(4)
Delay
tR
0
10
ns
(2)
VIDEO SIGNAL SET-UP TIME
tvideo
100
ns
Note : 1 Better if no clock transition occurs during “tsk” time.
Note : 2 tR+T
ΦR< ΦL2 high level duration.
Note : 3 Duty cycle: 50%
Note : 4 Rise time (tr) and fall time (tf) specified between 10% and 90%
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TH7422B
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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