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参数资料
| 型号： | TLC320AD50CDW |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| 封装： | PLASTIC, SO-28 |
| 文件页数： | 42/56页 |
| 文件大小： | 555K |
| 代理商： | TLC320AD50CDW |
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6–2
6.2
Control Register 2
Table 6–3. Control Register 2
D7
D6
D5
D4
D3
D2
D1
D0
DESCRIPTION
X
–
FLAG output value
–
1
–
Phone mode enable
–
0
–
Phone mode disable
–
X
–
Decimator FIR overflow flag (valid only during read cycle)
–
1
–
16-bit ADC mode
–
0
–
Not-16-bit ADC mode [(15+1)– bit mode]
–
X
0
Reserved (TLC320AD50C only)
–
0
FSD enable (TLC320AD52C only)
–
1
–
FSD disable (TLC320AD52C only)
–
1
–
Analog loopback enabled
–
0
–
Analog loopback disabled
Default value: 00000000
Writing 0s to the reserved bits is suggested.
6.3
Control Register 3
The following command contains the frame-sync delay (FSD) register address and loads D7 (MSB)–D0 into the FSD
register. The data byte (D5–D0) determines the number of SCLKs between FS and the delayed frame-sync signal,
FSD. The minimum data value for this portion of the register, bits D5–D0, is decimal 18.
Table 6–4. Control Register 3
D7
D6
D5
D4
D3
D2
D1
D0
DESCRIPTION
–
X
Number of SCLKs between FS and FSD
X
–
Binary number of slave devices (3 maximum for TLC320AC50C, 1 maximum for
TLC320AC52C)
Default value: 00000000
Writing 0s to the reserved bits is suggested.
6.4
Control Register 4
Table 6–5. Control Register 4
D7
D6
D5
D4
D3
D2
D1
D0
DESCRIPTION
–
1
–
Analog input gain = mute
–
1
0
–
Analog input gain = 12 dB
–
0
1
–
Analog input gain = 6 dB
–
0
–
Analog input gain = 0 dB
–
1
Analog output gain = mute
–
1
0
Analog output gain = – 12 dB
–
0
1
Analog output gain = – 6 dB
–
0
Analog output gain = 0 dB
–
X
–
Sample frequency select (N): fs = MCLK/(128 N) or MCLK/(512 N)
1
–
Bypass internal DPLL
0
–
Enable internal DPLL
Default value: 00000000
The value of the sample frequency divisor, N, is determined by the octal representation of bits D4–D6. Hence,
001 = 1, 010 = 2, etc. By setting D4–D6 to 000, N = 8 is selected.
相关PDF资料 |
PDF描述 |
|---|---|
| TLC320AD52CDWR | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| TLC320AD50IDW | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| TLC320AD50CPTR | SPECIALTY ANALOG CIRCUIT, PQFP48 |
| TLC320AD50IPTR | SPECIALTY ANALOG CIRCUIT, PQFP48 |
| TLC320AD50IPT | SPECIALTY ANALOG CIRCUIT, PQFP48 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| TLC320AD50CDWR | 功能描述:接口—CODEC SNGL CH Codec RoHS:否 制造商:Texas Instruments 类型: 分辨率: 转换速率:48 kSPs 接口类型:I2C ADC 数量:2 DAC 数量:4 工作电源电压:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:DSBGA-81 封装:Reel |
| TLC320AD50C-I | 制造商:TI 制造商全称:Texas Instruments 功能描述:SIGMA-DELTA ANALOG INTERFACE CIRCUITS WITH MASTER-SLAVE FUNCTION |
| TLC320AD50CPT | 功能描述:接口—CODEC SNGL CH Codec RoHS:否 制造商:Texas Instruments 类型: 分辨率: 转换速率:48 kSPs 接口类型:I2C ADC 数量:2 DAC 数量:4 工作电源电压:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:DSBGA-81 封装:Reel |
| TLC320AD50CPTR | 功能描述:接口—CODEC SNGL CH Codec RoHS:否 制造商:Texas Instruments 类型: 分辨率: 转换速率:48 kSPs 接口类型:I2C ADC 数量:2 DAC 数量:4 工作电源电压:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:DSBGA-81 封装:Reel |
| TLC320AD50I | 制造商:TI 制造商全称:Texas Instruments 功能描述:SIGMA-DELTA ANALOG INTERFACE CIRCUITS WITH MASTER-SLAVE FUNCTION |
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